主从JK触发器的问题讨论--《长江大学学报(自科版)》2004年04期
主从JK触发器的问题讨论
【摘要】：深入分析了JK触发器的工作原理,总结出了描述其功能的12字口诀,提出了选择CP参数的原则。对一次变化现象作了全面的讨论,论述了一次变化现象和空翻问题不可同时消除的实质。
【作者单位】：
【分类号】：TN783
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数字电路逻辑设计1、边沿D触发器、施密特触发器、主从JK触发器、边沿JK触发器、单稳态触发器、多谐振荡器、异步计数器哪几种属于脉冲单元电路的范畴?2．写出下降沿触发边沿JK触发器的特征（状态）方程?
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JK触发器的特征方程:Qn+1=J*Qn的逆+K的逆*Qn主从JK触发器、边沿JK触发器,边沿D触发器属于脉冲单元电路的范畴
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数字电路——4.1.基本R-S 触发器.ppt 80页
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数字电路——4.1.基本R-S 触发器
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基本R－S 触发器 1.特性方程 由功能表画出卡诺图得特性方程： 4.2.4．同步触发器的空翻现象
在一个时钟脉冲周期中，触发器发生多次翻转的现象叫做空翻。 2．逻辑功能 （3）状态转换图 （4）驱动表 例4.1
已知主从JK触发器J、K的波形如图所示，画出输出Q的波形图（设初始状态为0）。 4.4
边沿触发器 4.4.1、维持—阻塞边沿D触发器
1．D触发器的逻辑功能 D触发器只有一个触发输入端D，因此，逻辑关系非常简单； D触发器的状态转换图： D触发器的驱动表： 2．维持—阻塞边沿D触发器的结构及工作原理 （1）同步D触发器： 例
已知维持—阻塞D触发器的输入波形，画出输出波形图。 解：在波形图时，应注意以下两点： （1）触发器的触发翻转发生在CP的上升沿。 （2）判断触发器次态的依据是CP上升沿前一瞬间输入端D的状态。 根据D触发器的功能表，可画出输出端Q的波形图。
3.触发器的直接置0和置1端
RD——直接置0端，低电平有效；SD——直接置1端；低电平有效。 4.4.2CMOS主从结构的边沿触发器 1．电路结构:由CMOS逻辑门和CMOS传输门组成主从D触发器。 2．工作原理 触发器的触发翻转分为两个节拍： （1）当CP变为1时，TG1开通，TG2关闭。主触发器接收D信号。同时，TG3关闭，TG4开通，从触发器保持原状态不变。 （2）当CP由1变为0时，TG1关闭，TG2开通，主触发器自保持。同时，TG3开通，TG4关闭，从触发器接收主触发器的状态。 4.6 集成触发器 4.6.1、集成触发器举例 1．TTL主从JK触发器74LS72 2．高速CMOS边沿D触发器74HC74
4.6.3触发器的应用举例
设计一个3人抢答电路。3人A、B、C各控制一个按键开关KA、KB、KC和一个发光二极管DA、DB、DC。谁先按下开关，谁的发光二极管亮，同时使其他人的抢答信号无效。
利用触发器的“记忆”作用，使抢答电路工作更可靠、稳定。 本章小结 1．触发器有两个基本性质：（1）在一定条件下，触发器可维持在两种稳定状态（0或1状态）之一而保持不变；（2）在一定的外加信号作用下，触发器可从一个稳定状态转变到另一个稳定状态。 2．描写触发器逻辑功能的方法主要有特性表、特性方程、驱动表、状态转换图和波形图(又称时序图)等。 3．按照结构不同，触发器可分为：
(1) 基本RS触发器，为电平触发方式。
(2) 同步触发器，为脉冲触发方式。
(3) 主从触发器，为脉冲触发方式。
(4) 边沿触发器，为边沿触发方式。 本章小结 4．根据逻辑功能的不同，触发器可分为：
(1) RS触发器
(2) JK触发器
(3) D触发器
(4) T触发器
（T’触发器 ）
5．同一电路结构的触发器可以做成不同的逻辑功能；同一逻辑功能的触发器可以用不同的电路结构来实现。 6．利用特性方程可实现不同功能触发器间逻辑功能的相互转换。 比较，得： 电路图 2、将D触发器转换为JK、T、 T＇和RS触发器 （1）D触发器→JK触发器 （2）D触发器→T触发器 （3）D触发器→T＇触发器 （4）D触发器→RS触发器 或 约束条件为RS＝0
3、将T 触发器转换为JK、 D 、 T＇和RS触发器 （1） T触发器→ JK触发器 利用 可得到T的激励方程： （2） T触发器→ D触发器 （3） T触发器→ T＇ 触发器 所以 所以 （4） T触发器→ RS触发器 所以 利用约束条件RS＝0，得: 4、将 RS触发器转换为JK、 D 、 T＇和T触发器 （1） RS触发器→ JK触发器 将JK触发器的特性方程变换为 将该式与RS触发器的特性方程
（2） RS触发器→ D触发器 将D触发器的特性方程变换为 将该式与RS触发器的特性方程
满足RS＝0的约束条件。 （3） RS触发器→ T触发器 将D触发器的特性方程变换为 将该式与RS触发器的特性方程
满足RS＝0的约束条件。 （4） RS触发器→ T’触发器 将D触发器的特性方程变换为 将该式与RS触发器的特性方程
满足RS＝0的约束条件。 特点：（1）有3个J端和3个K端，它们之间是与逻辑关系。 （2）带有直接置0端RD和直接置1端SD，都为低电平有效，不用时应接高电平。 （3）为主从型结构，CP下跳沿触发。 特点：（1）单输入端的双D触发器。 （2）它们都带有直接置0端RD和直接置1端SD，为低电平有效。 （3）为CMOS边沿触发器，CP上升沿触发。 0 1
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《数字逻辑电路》 作业 求解.50分/
1.一个8选一数据选择器的数据输入端有（）个A.1B.2C.3D.82.8位移位寄存器，串行输入时经（）个脉冲后，8位数码全部移入寄存器中A.1B.2C.4D.83.下列触发器中，没有约束条件的是（）A.基...
一个8选一数据选择器的数据输入端有（ ）个A. 1B. 2C. 3D. 8
8位移位寄存器，串行输入时经（ ）个脉冲后，8位数码全部移入寄存器中A. 1B. 2C. 4D. 8
下列触发器中，没有约束条件的是（ ）A. 基本RS触发器B. 主从RS触发器C. 同步RS触发器D. 边沿D触发器
与十进制数（53.5）10等值的数或代码为( ).A. (01)8421BCDB. (36.8)16C. ()2D. (65.7)8
一个16选一的数据选择器，其地址输入（选择控制输入）端有（ ）个.A. 1B. 2C. 4D. 16
边沿式D触发器是一种（ ）稳态电路A. 无B. 单C. 双D. 多
在何种输入情况下，“与非”运算的结果是逻辑0( ).A. 全部输入是0B. 任一输入是0C. 仅一输入是0D. 全部输入是1
与八进制数(47.3)8等值的数为( ).A. ()2B. (27.8)16C. (27.3)16D. ()2
以下表达式中符合逻辑运算法则的是( ).A. C·C=C2B. 1+1=10C. 0&1D. A+1=1
为实现将JK触发器转换为D触发器，应使（ ）A. J=D,K=/DB. K=D,J=/DC. J=K=DD. J=K=/D
若在编码器中有50个编码对象，则要求输出二进制代码位数为（ ）位A. 5B. 6C. 10D. 50
对于D触发器，欲使Qn+1=Qn，应使输入D=（ ）A. 0B. 1C. QD. /Q
欲使JK触发器按Qn+1=1工作，可使JK触发器的输入端（ ）A. J=K=1B. J=1,K=0C. J=K=/Q或BD. J=K=0
把一个5进制计数器与一个10进制计数器串联可得到（ ）进制计数器A. 4B. 5C. 9D. 20
以下代码中为无权码的为( ).A. 8421BCD码B. 5421BCD码C. 余三码D. 2421码
描述触发器的逻辑功能的方法不包括（ ）A. 状态转表B. 特性方程C. 状态转换图D. 状态方程
在下列触发器中，有约束条件的是（ ）A. 主从JK F/FB. 主从D F/FC. 同步RS F/FD. 边沿D F/F
同步计数器和异步计数器比较，同步计数器的显著优点是（ ）。A. 工作速度高B. 触发器利用率高C. 电路简单D. 不受时钟CP控制
N个触发器可以构成最大计数长度（进制数）为（ ）的计数器A. NB. 2NC. N的平方D. 2的N次方
对于T触发器，若原态Qn=0，欲使新态Qn+1=1，应使输入T=（ ）A. 0B. 1C. QD. /Q或1
以下代码中为恒权码的为( ).A. 循环码B. 5421BCD码C. 余三码D. 格雷码
下列触发器中，有空翻现象的有（ ）A. 边沿D触发器B. 主从RS触发器C. 同步RS触发器D. 主从JK触发器
欲使JK触发器按Qn+1=Qn工作，可使JK触发器的输入端（ ）A. J=K=1B. J=Q,K=/QC. J=/Q ,K=QD. J=Q,K=1
N个触发器可以构成能寄存（ ）位二进制数码的寄存器A. N-1B. NC. N+1D. 2N
对于T触发器，若原态Qn=1，欲使新态Qn+1=1，应使输入T=（ ）A. 0或/QB. 1C. QD. /Q
一位十六进制数可以用( )位二进制数来表示A. 1B. 2C. 4D. 16
下列逻辑电路中为时序逻辑电路的是（ ）A. 变量译码器B. 加法器C. 数码寄存器D. 数据选择器
卡诺图上变量的取值顺序是采用( )的形式，以便能够用几何上的相邻关系表示逻辑上的相邻。A. 二进制码B. 循环码C. ASCII码D. 十进制码
A+BC= ( ).A. A+BB. A+CC. （A+B）（A+C）D. B+C
对于JK触发器，若J=K，则可完成（ ）触发器的逻辑功能A. RSB. DC. TD. T'31.
程序控制中,常用下列哪种电路作定时器（ ）A. 比较器B. 计数器C. 译码器D. 编码器
存储8位二进制信息要（ ）个触发器A. 2B. 3C. 4D. 8
常用的BCD码有( ).A. 奇偶校验码B. 格雷码C. 8421码D. 汉明码
以下电路中，加以适当辅助门电路，（ ）适于实现单输出组合逻辑电路A. 奇偶校验器B. 数据选择器C. 数值比较器D. 七段显示译码器
在一个8位的存储单元中，能够存储的最大无符号整数是( ).A. （256）10B. （127）10C. （FE）16D. （255）10
在何种输入情况下，“或非”运算的结果是逻辑1( ).A. 全部输入是0B. 全部输入是1C. 任一输入为0，其他输入为1D. 任一输入为1
同步时序电路和异步时序电路比较，其差异在于后者（ ）A. 没有触发器B. 没有统一的时钟脉冲控制C. 没有稳定状态D. 输出只与内部状态有关
在下列逻辑电路中，不是组合逻辑电路的有（ ）A. 译码器B. 编码器C. 全加器D. 寄存器
当逻辑函数有n个变量时，共有( )个变量取值组合？A. nB. 2nC. n的平方D. 2的n次方
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一个8选一数据选择器的数据输入端有（D）个A. 1
数据端有8个，地址端3个，数据输出1个
8位移位寄存器，串行输入时经（D）个脉冲后，8位数码全部移入寄存器中A. 1B. 2C. 4D. 8
每个脉冲移入1位
下列触发器中，没有约束条件的是（D）A. 基本RS触发器
只要是RS触发器，都有约束条件：不得出现R=S=1的情况B. 主从RS触发器C. 同步RS触发器D. 边沿D触发器
与十进制数（53.5）10等值的数或代码为(A).A. (01)8421BCDB. (36.8)16
--- 54.5C. ()2
-----37.5D. (65.7)8
-------53.875
一个16选一的数据选择器，其地址输入（选择控制输入）端有（C）个.A. 1B. 2C. 4
2^4 = 16D. 16
边沿式D触发器是一种（C）稳态电路A. 无B. 单C. 双D. 多
在何种输入情况下，“与非”运算的结果是逻辑0(D).A. 全部输入是0B. 任一输入是0C. 仅一输入是0D. 全部输入是1
1 AND 1 = 1, 所以 NOT（1 AND 1） = 0
与八进制数(47.3)8等值的数为(A).A. ()2
3位2进制对应1为8进制B. (27.8)16C. (27.3)16D. ()2
以下表达式中符合逻辑运算法则的是(D).A. C·C=C2B. 1+1=10C. 0&1D. A+1=1
为实现将JK触发器转换为D触发器，应使（ A ）A. J=D,K=/DB. K=D,J=/DC. J=K=D
若在编码器中有50个编码对象，则要求输出二进制代码位数为（B）位A. 5B. 6
2^6 = 64 & 50C. 10D. 50
对于D触发器，欲使Qn+1=Qn，应使输入D=（ C ）A. 0B. 1C. QD. /Q
欲使JK触发器按Qn+1=1工作，可使JK触发器的输入端（ B ）A. J=K=1B. J=1,K=0C. J=K=/Q或BD. J=K=0
把一个5进制计数器与一个10进制计数器串联可得到（ D ）进制计数器A. 4B. 5C. 9D. 20
新计数器的模是10的整倍数
以下代码中为无权码的为( C ).A. 8421BCD码B. 5421BCD码C. 余三码D. 2421码
描述触发器的逻辑功能的方法不包括（ B ）A. 状态转表B. 特性方程C. 状态转换图D. 状态方程
在下列触发器中，有约束条件的是（ C ）A. 主从JK F/FB. 主从D F/FC. 同步RS F/FD. 边沿D F/F
同步计数器和异步计数器比较，同步计数器的显著优点是（ A ）。A. 工作速度高B. 触发器利用率高C. 电路简单D. 不受时钟CP控制
N个触发器可以构成最大计数长度（进制数）为（ D ）的计数器A. NB. 2NC. N的平方D. 2的N次方
对于T触发器，若原态Qn=0，欲使新态Qn+1=1，应使输入T=（D）A. 0
保持D. /Q或1
翻转，选这个是因为答案比较全
以下代码中为恒权码的为( B ).A. 循环码B. 5421BCD码C. 余三码D. 格雷码
下列触发器中，有空翻现象的有（ D ）A. 边沿D触发器B. 主从RS触发器C. 同步RS触发器D. 主从JK触发器
欲使JK触发器按Qn+1=Qn工作，可使JK触发器的输入端（B）A. J=K=1B. J=Q,K=/Q
当Qn=0，J=0，K=1，输出0；当Qn=1，J=1，K=0，输出1C. J=/Q ,K=QD. J=Q,K=1
N个触发器可以构成能寄存（B）位二进制数码的寄存器A. N-1B. NC. N+1D. 2N
对于T触发器，若原态Qn=1，欲使新态Qn+1=1，应使输入T=（A）A. 0或/QB. 1C. QD. /Q
一位十六进制数可以用( C )位二进制数来表示A. 1B. 2C. 4D. 16
下列逻辑电路中为时序逻辑电路的是（C）A. 变量译码器B. 加法器C. 数码寄存器D. 数据选择器
卡诺图上变量的取值顺序是采用( B )的形式，以便能够用几何上的相邻关系表示逻辑上的相邻。A. 二进制码B. 循环码C. ASCII码D. 十进制码
A+BC= ( C ).A. A+BB. A+CC. （A+B）（A+C）D. B+C
对于JK触发器，若J=K，则可完成（C）触发器的逻辑功能A. RSB. DC. TD. T&#39;问题补充： 31.
程序控制中,常用下列哪种电路作定时器（ B ）A. 比较器B. 计数器C. 译码器D. 编码器
存储8位二进制信息要（ D ）个触发器A. 2B. 3C. 4D. 8
常用的BCD码有( C ).A. 奇偶校验码B. 格雷码C. 8421码D. 汉明码
以下电路中，加以适当辅助门电路，（ B ）适于实现单输出组合逻辑电路A. 奇偶校验器B. 数据选择器C. 数值比较器D. 七段显示译码器
在一个8位的存储单元中，能够存储的最大无符号整数是( D ).A. （256）10B. （127）10C. （FE）16D. （255）10
在何种输入情况下，“或非”运算的结果是逻辑1( A ).A. 全部输入是0B. 全部输入是1C. 任一输入为0，其他输入为1D. 任一输入为1
同步时序电路和异步时序电路比较，其差异在于后者（ B ）A. 没有触发器B. 没有统一的时钟脉冲控制C. 没有稳定状态D. 输出只与内部状态有关
在下列逻辑电路中，不是组合逻辑电路的有（ D ）A. 译码器B. 编码器C. 全加器D. 寄存器
当逻辑函数有n个变量时，共有(
)个变量取值组合？A. nB. 2nC. n的平方D. 2的n次方总算做完了，采纳的话，记得加分啊，哈哈
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这个学太久了，都忘了，哥以前是高手哦
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作业要自己做的哦
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我们会通过消息、邮箱等方式尽快将举报结果通知您。锁存器(Latch)和触发器(Flip-flop)——《电子技术基础(数字部分)》读书笔记(三) - zxl2431 - 博客园
　　大多数数字系统中，除了需要具有逻辑运算和算术运算功能的组合逻辑电路外，还需要具有储存功能的电路，组合逻辑电路和储存电路相结合可构成时序逻辑电路，Lacth&& Flip-flop就是实现储存功能的两种逻辑单元电路。
　　锁存器是对电平敏感的电路，它们在一定电平作用下改变状态。基本SR锁存器由输入信号电平直接控制其状态，传输门控或逻辑门控锁存器在使能电平作用下由输入信号决定其状态。在使能信号作用期间，门控锁存器输出跟随输入信号变化而变化。
　　触发器则是对时钟脉冲边沿敏感的电路，根据不同的电路结构，它们在时钟脉冲的上升沿或下降沿作用下改变状态。目前流行的触发器电路主要有主从、维持阻塞和利用传输延迟等几种结构，它们的工作原理个不相同。
　　触发器按逻辑功能分类有D触发器、JK触发器、T触发器和SR触发器。它们的功能可用特性表、特性方程和状态图来描述。触发器的电路结构与逻辑功能没有必然联系。例如JK触发器既有主从结构也有维持阻塞或利用传输延迟结构。每一种逻辑功能的触发器都可以通过增加门电路和适当的外部连线转换为其它功能的触发器。
　　之所以能够有记忆功能能够存储信息，最主要的就是它把输出有反馈到了输入，形成了反馈这样它就能保持稳定。这使得Lacth & Flip-flop与组合逻辑电路的分析有了很大的不同，当然Latch & Flip-flop本来就只有这么几种，记住就行。不需要自己去创新。
　　从最基本的用两个或非门构成的SR锁存器到在前面加上两个与门和一个使能端E的逻辑门控SR锁存器，这样就可以实现多个锁存器同步进行数据锁存。但是SR锁存器有个很不好的地方就是当SR同时为1的时候，它会出现不确定状态，解决这个问题其实也很简单在逻辑门SR锁存器的S和R之间串上一个非门这样S和R永远都不会一样，当然同时为0的状态时有使能端E决定的，这个就是D锁存器，当E为1时，输出Q = D；当E为0时，输出Q保持之前的状态不变。再讲了传输门门控D锁存器，大致工作原理是当E为1的时候，放输入信号进来，当E为0时，锁存前一时刻(E=1时)的数据，后来就提出了在时序图中的几个基本概念：建立时间(Tsu)、保持时间(Th)、脉冲宽度(Tw)和传输延迟时间()。
　　触发器的电路结构就不仔细分析了，关键是看看几种触发器的逻辑功能，触发器在每次时钟脉冲触发沿到来之前的状态称为现态，而在此之后的状态称为次态。所谓触发器的逻辑功能，是指次态与现态、输入信号之间的逻辑关系。
　　D触发器功能比较简单，输出Q的值直接等于输入D就行。JK触发器由特性表，特性方程或状态图都可以看出，当J=1,K=0时，触发器的下一个状态被置1；当J=0,K=1时，将被置0；当J=K=0时，触发器状态保持不变；当J=K=1时，触发器翻转。在所有类型的触发器中JK触发器具有最强的逻辑功能，它能执行置1、置0、保持和翻转四种操作，并可以简单的附加电路转换为其他功能的触发器，因此在数字电路中被广泛应用。在某些场合，需要对计数功能进行控制，当控制信号T=1时，每来一个CP脉冲，它的状态翻转一次；而当T=0时，则不对CP信号做出响应而保持状态不变。这就是T触发器。其实T触发器很简单就是把JK触发器的JK两端接在了一起。仅有置位、复位功能的触发器称为SR触发器，并且还有约束条件SR=0。
　　各种触发器之间是可以很轻松的相互转换的，要会灵活应用。}