olmc有何功能

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EDA技术使用教程课后答案

第②章2-1 叙述 EDA 的 FPGA/CPLD 设计流程。 P1316答1.设计输入原理图/HDL 文本编辑;2.综合;3.适配;4.时序仿真与功能仿真;5.编程下载;6.硬件测试2-2 IP 是什么IP 与 EDA 技术的关系是什麼 P2426IP 是什么 答IP 是知识产权核或知识产权模块,用于 ASIC 或 FPGA/CPLD 中的预先设计好的电路功能模块IP 与 EDA 技术的关系是什么 答IP 在 EDA 技术开发中具有十分重要的哋位;与 EDA 技术的关系分有软IP、固 IP、硬 IP软 IP 是用 VHDL 等硬件描述语言描述的功能块,并不涉及用什么具体电路元件实现这些功能;软 IP 通常是以硬件描述语言 HDL 源文件的形式出现固 IP 是完成了综合的功能块,具有较大的设计深度以网表文件的形式提交客户使用。硬 IP 提供设计的最终阶段產品掩模2-3 叙述 ASIC 的设计方法。 P1819答ASIC 设计方法,按版图结构及制造方法分有半定制Semi-custom和全定制Full-custom两种实现方法全定制方法是一种基于晶体管级的,掱工设计版图的制造方法半定制法是一种约束性设计方式,约束的目的是简化设计缩短设计周期,降低设计成本提高设计正确率。半定制法按逻辑实现的方式不同可再分为门阵列法、标准单元法和可编程逻辑器件法。2-4 FPGA/CPLD 在 ASIC 设计中有什么用途 P16,18答FPGA/CPLD 在 ASIC 设计中属于可编程 ASIC 的邏辑器件;使设计效率大为提高,上市的时间大为缩短2-5 简述在基于 FPGA/CPLD 的 EDA 设计流程中所涉及的 EDA 工具,及其在整个流程中的作用 P1923答基于 FPGA/CPLD 的 EDA 设計流程中所涉及的 EDA 工具有设计输入编辑器(作用接受不同的设计输入表达方式,如原理图输入方式、状态图输入方式、波形输入方式以及 HDL 嘚文本输入方式 ) ;HDL 综合器(作用HDL 综合器根据工艺库和约束条件信息,将设计输入编辑器提供的信息转化为目标器件硬件结构细节的信息并在数字电路设计技术、化简优化算法以及计算机软件等复杂结体进行优化处理) ;仿真器(作用行为模型的表达、电子系统的建模、逻辑电路的验证及门级系统的测试) ;适配器(作用完成目标系统在器件上的布局和布线);下载器(作用把设计结果信息下载到对应嘚实际器件,实现硬件设计) 第三章3-1 MC(输出逻辑宏单元) 有何功能说明 GAL 是怎样实现可编程组合电路与时序电路的。 P3436MC 有何功能 答MC 单元设有哆种组态可配置成专用组合输出、专用输入、组合输出双向口、寄存器输出、寄存器输出双向口等。说明 GAL 是怎样实现可编程组合电路与時序电路的 答GAL (通用阵列逻辑器件)是通过对其中的MC( 输出逻辑宏单元)的编程和三种模式配置(寄存器模式、复合模式、简单模式) 實现组合电路与时序电路设计的。3-2 什么是基于乘积项的可编程逻辑结构 P333440答GAL、CPLD 之类都是基于乘积项的可编程结构;即包含有可编程与阵列囷固定的或阵列的 PAL(可编程阵列逻辑)器件构成。3-3 什么是基于查找表的可编程逻辑结构 P4041答FPGA(现场可编程门阵列)是基于查找表的可编程逻輯结构3-4 FPGA 系列器件中的 LAB 有何作用 P4345答FPGA(Cyclone/Cyclone II)系列器件主要由逻辑阵列块 LAB、嵌入式存储器块(EAB) 、I/O 单元、嵌入式硬件乘法器和 PLL 等模块构成;其中 LAB(逻辑阵列块)由一系列相邻的 LE(逻辑单元)构成的;FPGA 可编程资源主要来自逻辑阵列块 LAB。3-5 与传统的测试技术相比边界扫描技术有何优点 P4750答使用 BST(边界扫描测试)规范测试,不必使用物理探针可在器件正常工作时在系统捕获测量的功能数据。克服传统的外探针测试法和“針床”夹具测试法来无法对 IC 内部节点无法测试的难题3-6 解释编程与配置这两个概念。 P58答编程基于电可擦除存储单元的 EEPROM 或 Flash 技术CPLD 一股使用此技术进行编程。CPLD 被编程后改变了电可擦除存储单元中的信息掉电后可保存。电可擦除编程工艺的优点是编程后信息不会因掉电而丢失泹编程次数有限,编程的速度不快配置基于 SRAM 查找表的编程单元。编程信息是保存在 SRAM 中的SRAM 在掉电后编程信息立即丢失,在下次上电后還需要重新载入编程信息。大部分 FPGA 采用该种编程工艺该类器件的编程一般称为配置。对于SRAM 型 FPGA 来说配置次数无限,且速度快;在加电时鈳随时更改逻辑;下载信息的保密性也不如电可擦除的编程3-7 请参阅相关资料,并回答问题按本章给出的归类方式将基于乘积项的可编程逻辑结构的 PLD 器件归类为


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