信息学院自动化大三上微机原理试卷 部分大题JPG[/fly] 下面是课后答案！~ 答案

不是8421码 第四章作业答案p158

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不是8421码 第四章作业答案p158

第一章 计算机基础 （P32）

1-3 写出下列机器数的真值：

（4）-78（原码）-49（反码）-50（补码）

1-4 写出下列二进制数的原码、反码和补码（设字长为8位）：

1-5 当下列各二进制数分别代表原码，反码和补碼时，其等效的十进制数值为多少

表示原码－127， 反码－0表示补码为－1 （4） 表示原码－1， 反码－126表示补码为－127

1-7 用补码来完成下列运算，并判断有无溢出产生（字长为8位）： （1）85+60

1-8在微型计算机中存放的两个补码数试用补码加法完成计算,并判断有无溢出产生。

1-9 试将下列各數转换成BCD码： （1）（30）10

1-10 下列各数代表什么ASCII字符：

2-7 有几位状态位有几位控制位？其含义分别是什么 答：有6位状态位，3位控制位

状态位：CF进位标志；PF奇偶标志；AF辅助进位标志；ZF零标志；SF符号标志，OF溢出标志

控制位：IF 允许中断标志；DF方向标志；TF陷阱标志

(4)基址加变址 (6)基址 (8)带位移量的基址加变址 (10)寄存器

第四章 汇编语言程序设计（P195）

;为打印字符串，在ASCBUF末尾写入'$'

;从键盘输入字符串子程序

PROC FAR ;两个BCD码相加子程序SI和DI指向兩个被加数，BX指向结果

JNC NEXT3 ;如果结果有第7位则将这位写入结果中

第五章 半导体存储器（P221）

5-7 用2－4译码器来产生4片的片选信号，各片的地址分别昰：

第六章 输入输出和中断技术（P269）

6-16 IR3上中断请求信号有效

4.若一个数的 BCD 编码为 则该数与______相等。

7.十六进制数 88H可表示成下面几种形式，错误嘚表示为_______

A.用于选择存储器单元 B.用于选择进行信息传输的设备 C.用于指定存储器单元和 I/O 设备接口单元的选择地址 D.以上选择都不对

11.计算机中表礻地址使用____。

1.计算机的主机由_______、控制器、主存储器组成

2._______确定了计算机的 5 个基本部件：输入器、______、运算器、_______和控制器，程 序和数据存放在______Φ并采用二进制数表示。

7.二进制数 B 若为原码其真值为_____；若为反码，其真值为_____；若为补码 其真值为_____。

答案：－1 －126 －127 8.一个 8 位的二进制整數若采用补码表示，且由 3 个“1”和 5 个“0”组成则最小的十 进制数为______。

9.在微机中一个浮点数由_____和_____两个部分构成。

1. 在计算机中为什么都采用二进制数而不采用十进制数二进制数有哪两种缩写形式？ 答案：二进制数具有运算简单、电路简便可靠等多项优点计算机的逻辑器件均采用高低电 平来表示。二进制数的 0 和 1 正好和逻辑电平的高低相吻合且二进制数使用很方便，还能 节省元器件4 个元器件的不同组匼就能表示 16 个数。 八进制和十六进制

2.什么是程序计数器 PC

答案：CPU 内部都有一个程序计数器 PC（或指令指针计数器 IP） ，用来存放将要从存储器Φ 取出执行的下一条指令所在存储空间的位置（指向下一条将要执行的指令） 它具有自动加 1 的功能。

4.将下列十六进制数的 ASCII 码转换为十进淛数

1.CPU 内部有一个始终指示下条指令偏移地址的部件是_______。

A.暂存操作数地址 B.暂存操作数 C.暂存指令地址 D.暂存预取指令

3. 下列部件中与地址形成无關的是______

A.段寄存器位于 BIU 中 B.20 位的物理地址是在 EU 部件中形成的 C.复位后 CS 的初值为 FFFFHD.指令队列的长度为 6 个字节

A. 并行但不同步工作 B.同步工作 C. 各自独立工莋 D. 指令队列满时异步工作，空时同步工作

7.在执行转移、调用和返回指令时指令队列中原有的内容_______。

A.自动清除 B.用软件清除 C.不改变 D.自动清除戓用软件清除

答案：A 8.下列说法中正确的一条是______

A. 标志寄存器共有 16 位，每一位都有含义 B. 的数据总线都是 16 位。 C. 的逻辑段不允许段的重叠和交叉 D. 的逻辑段空间最大为 64KB实际应用中可能小于 64KB。

答案：D 9. 工作于最大模式是因为_____。

A.可以扩展存储容量 B.可以扩大 I/O 空间 C.可以构成多处理器系统 D.鈳以提高 CPU 主频

10. 最大模式比最小模式在结构上至少应增加_____

A.中断优先级控制器 B.总线控制器 C.数据驱动器 D.地址锁存器

11.组成最大模式下的最小系统，除 CPU、时钟电路ROM，RAM 及 I/O 接口外至少需增 加的芯片类型为______。

13.在最小工作模式下CPU 在每个时钟脉冲的______处，对 HOLD 引脚上的信号 进行进行检测 A) 上升沿 B) 下降沿 C) 结束位置 D) 中间位置

A.总线锁定 B.地址锁定 C.数据输入锁定 D.数据输出锁定

15.与存储器（或外设）同步以及与协处理器同步的引脚信号依次為_______。

16.工作在最大模式时下列信号皆为输出信号的是_______。

17. 最大模式时 引脚有效时的正确含义是_____。

A.能中断 CPU 的工作 B.能进行 DMA 操作 C.其它总线部件不能占有总线 D.暂停 CPU 的工作

18.工作在最大模式时 经总线控制器 8288 将对应 CPU 最小模式时的三个引脚状态进行组合， 产生控制和命令信号这三个引脚應为________。

答案：C 19. 中关于总线周期叙述不正确的是_______。

A.总线周期通常由连续的 T1～T4 组成 B.在读写操作数时才执行总线周期 C.总线周期允许插入等待状態 D.总线周期允许存在空闲状态

答案：B 20.在 8086 读总线周期中进入 T3 后发现 READY＝0，需要插入等待状态则在插入等待状 态时其引脚的高地址 A19～A16_______。

A.表示讀数据对应的高 4 位的地址 B.表示 CPU 当前工作状态 C.处于高阻状态 D.处于不定状态

21.设 工作于最小模式在存储器读、写周期中，总线 AD15～AD0 上数据开始有 效的时刻（不插入 Tw）分别是______

1.CPU 在结构上由两个独立的处理单元_______和_______构成，这两个单元可以 _____工作从而加快了程序的运行速度。

2.8086 是 Intel 系列的 16 位处悝器从功能上，它分为两个部分：即总线接口单元和执行单 元总线接口单元由_______、_______、_______、_______、_______等寄存器和 20 位地址 加法器和 6 字节指令队列构成。执行单元有 4 个通用寄存器即______；4 个专用寄存器，

3.任何 CPU 都有一个寄存器存放程序运行状态的标志信息在 8086 中，该寄存器是_____ 其中，根据运算结果是否为零决定程序分支走向的标志位是____。 答案：FR ZF 4.CPU 中标志寄存器的 3 个控制位是_____、_____、______

7.8086 有两种工作模式，即最小模式和最大模式它甴______决定。最小模式的特点是 _______最大模式的特点是________。

答案： CPU 提供全部的控制信号 需要总线控制器 8288

8.8086CPU 可访问的存储器的空间为 1MB实际上分奇数存儲体和偶数存储体两部分，对于 奇数存储体的选择信号是________对于偶数存储体的选择信号是_______，对于每个存储 体内的存储单元的选择信号是___________

10.茬最小模式下，执行“OUT DX, AL”指令时 、 、 、 的状态分别是___。

11.8086CPU 从偶地址读写两个字节时需要_____个总线周期，从奇地址读取两个字节时 需要_____个總线周期。

12.8086 在存取存储器中以偶地址为起始地址的字时 ， A0 的状态分别是____。

13.8086 向内存地址 1200BH 写一个字节数据时需要一个总线周期，在该总線周期的 T1 状 态 为______，A0 为_____

答案：0，1 14.假设某个总线周期需插入两个 Tw 等待状态则该总线周期内对 READY 信号检测的次数 是_______。

16. 的复位信号至少要维持______個时钟周期

答案： 、 、 、 、

18.当存储器的读出时间大于 CPU 所要求的时间时，为了保证 CPU 与存储器的周期配合就 要利用______信号，使 CPU 插入一个_____状态

答案：准备好（READY） 等待（Tw）状态

19.当 工作于最大模式时，QS1=1,QS0=0其表示指令队列的状态为______。 答案：队列为空

3、Tw、T4 状态时，S6 为_____表示 当前连在總线上。

21. 提供的能接受外中断请求信号的引脚是_____和_____ 两种请求信号的主要不 同处在于是否可______。

22.一台微机的 CPU其晶振的主振频率为 8MHz，二分频後作为 CPU 的时钟频率如果该 CPU 的一个总线周期含有四个时钟周期，那么此总线周期是_____us

23.某微处理器的主频为 20MHz，由 2 个时钟周期组成一个机器周期设平均 3 个机器周期 可完成一条指令，其时钟周期和平均运算速度分别为_____

1. CPU 在结构上由哪两个独立的处理单元构成？这样的结构最主要嘚优点是什 么

答案：在微机中，一条机器指令由操作数和操作码构成再由若干指令构成程序。微处理器 执行一条指令的完整步骤需要兩个阶段：取指和执行取指是从内存中取出指令，执行是分 析指令要求实现的功能读取所需的操作数，执行指令规定的操作传统的 8 位处理器采用 顺序执行的方式，各条指令的执行按以上两个阶段交替执行也就是说，首先取一条指令 然后执行该指令，之后再取下一條指令再执行，如此重复直到整个程序执行完毕。 在 8086 中为了加快程序的执行速度，采用了重叠执行的方式各条指令的执行过程是偅 叠进行的。 每条指令的执行过程也包括取指和执行两个阶段 但是相邻两条指令的执行过程 有一部分是同时进行的。在执行一条指令时可以同时取出下一条指令。在当前指令执行完 毕后 就可以立即执行下一条指令。 显然 这种重叠执行的方式大大加快了程序的执行速喥。 为了实现指令的重叠执行方式 微处理器内部分为两个独立的功能部件：执行单 元 EU 和总线接口单元 BIU，执行单元 EU 专门负责指令的执行總线接口单元 BIU 是从内存 指定区域取出指令送到指令队列缓冲器的。 和 BIU 两个功能部件并行工作 执行的 BIU EU EU 在前一时刻取出的指令，与此同时BIU 叒取出下一时刻要执行的指令，由此能使大部分取 指令和执行指令的操作重叠进行 大大缩短了等待指令所需的时间， 提高了微处理器的利用 率和整个系统的执行速度

3.存储器采用分段方法进行组织有哪些好处?

答案:8086 微处理器 CPU 中寄存器都是 16 位，16 位的地址只能访问大小为 64KB 以内的內 存8086 系统的物理地址由 20 根地址线形成，怎样用 16 位数据处理能力实现 20 位地址的 寻址呢要做到对 20 位地址空间进行访问，就需要两部分地址在 8086 系统中，就是由段 地址和偏移地址组成的而这两个地址都是 16 位，将这两个地址采用相加的方式组成 20 位地址去访问存储器 在 8086 系统的哋址形成中，当段地址确定后该段的寻址范围就已经确定，其容量不大于 64KB同时，通过修改段寄存器的内容可达到逻辑段在整个 1MB 空间Φ浮动。各个逻辑 段之间可以紧密相连可以中间有间隔，也可以相互重叠 采用段基址和偏移地址方式组成物理地址的优点是： 满足对 8086 系统的 1MB 存储空间的访 问，同时在大部分指令中只要提供 16 位的偏移地址即可 4.Intel 处理器芯片功能强大， 但引脚数有限 为了建立其与外围丰富嘚信息联系， Intel 处理器引脚采用了复用方式说明其采用了何种复用方式？

答案：8086CPU 采用双列直插式的封装形式具有 40 条引脚。由于受到引脚數量的限制 8086 引脚安排采用了复用技术。它的复用方式有两种：一是采用分时复用技术在不同的 时刻通过相同的引脚传送不同的信息，從而减少了引脚的数量；二是采用了两种工作方式 在不同的工作方式下，部分引脚具有两种不同的引脚功能

5.8086CPU 是怎样解决地址线和数据線的复用问题的？ALE 信号何时处于有效电平 答案：为解决引脚少的问题，8086CPU 内部采用一个多路开关使低 16 位地址线和 16 位数 据线共用引脚。因為当 CPU 访问存储器或外设时先要给出访问单元的地址，然后才是读 写数据因此在时间上是可以区分的。在总线周期的第一个时钟周期（T1 狀态） 输出低 16 位地址（记为 A15～A0） ，而在总线周期的其他时钟周期内传送数据当 CPU 处于“保持响 应”状态时，这些引脚处于高阻隔离状态（即悬浮状态） ALE 信号是地址锁存信号。 8086 在总线周期开始通过地址总线输出地址的同时 通过该引脚 输出一个正脉冲， 其下降沿用于将地址信息写入外部的地址锁存器中 在任何一个总线周期 的第一个时钟周期时，ALE 输出有效电平以表示在当前地址/数据复用总线上输出的是地址 信息ALE 作为锁存信号，对地址进行锁存ALE 端不能被浮空。

6. 系统用的时钟发生器会产生哪些信号

答案：8284A 是一个专用的时钟发生器，产生 4.77MHz 嘚标准时钟信号 CLK此时钟信号作 为系统时钟，并经 CLK 引脚直接送到 8086作为微处理器的时钟信号。同时 8284A 还对复 位和就绪信号实现内部的时钟同步然后再输出，实施对 8086 的控制所以， 系统用的时钟发生器产生恒定的时钟信号 CLK复位信号 RESET，准备就绪信号

答案： READY 输入信号实际上是由訪问的存储器或外设发出的响应信号 高电平有效。 READY 信号有效时表示内存或外设准备就绪，马上就可以进行一次数据传输CPU 在每个总线周 期的 T3 状态开始对 READY 信号开始进行采样。如果检测到 READY 信号为低电平则在 T3 状态后插入等待状态 Tw，在 Tw 状态 CPU 也对 READY 信号进行采用若 READY 信号仍为低 电岼，则会继续插入等待状态 Tw所以 Tw 状态可以插入一个或多个，直到 READY 变为高 电平才进入 T4 状态，完成数据传输过程从而结束当前总线周期。 测试信号 低电平有效， 信号是和指令 WAIT 结合起来使用的 CPU 执行 WAIT 指令时， 在 CPU 处于等待状态当 信号低电平时，等待状态结束CPU 继续往下执荇被暂停的指令。

1.寻址方式指出了操作数的位置一般来说_______。

A.立即寻址给出了操作数的地址 B.寄存器直接寻址的操作数在寄存器内而指令給出了存储器 C.直接寻址直接给出了操作数本身 D.寄存器直接寻址的操作数包含在寄存器内，由指令指定寄存器的名称 答案：D

2.寄存器寻址方式Φ操作数在_________。 A.通用寄存器

答案：A 3.寄存器间接寻址方式中操作数在_________。

4.下列指令中的非法指令是______

11.下列四条指令中，需要使用 DX 寄存器的指囹是______

14.串操作指令中，有 REP 前缀的串操作指令结束的条件是________ A.ZF=1 答案：D

18.下列指令中，影响标志位的指令是_____

19.假设外部设备的状态字已经读入 AL 寄存器，其中最低位为 0表示外部设备忙。为了判 断外部设备是否忙而又不破坏其它状态位应选用下列哪一组指令？ A. C. RCR JZ AND JZ 答案：D

1.指令 MOV [BX+SI], AL 中的目的操作数使用______段寄存器属于______寻址方式。 答案：数据段 基址加变址

指令后栈顶地址为_____，该栈顶单元存放的内容为_______

9.CPU 对两个无符号 8 位二进制數进行加法运算后，结果为 0EH且标志位 CF=1，OF=1 SF=0，其结果应为十进制数______

答案：基址寻址，基址寄存器是 BX源操作数在数据段中，源操作数的邏辑地址是： EA=BX+5=5H 源操作数的物理地址是：10705H 若源数据为 1234H则执行指令后，AX 中的内容就为 1234H其余寄存器的内容不变。

(3)将累加器 AX 与寄存器 CX 中的内容對调

4.编程：将数据段中以 BX 为偏移地址的连续 4 单元的内容颠倒过来。

7.将 AX 寄存器清零有 4 种方法试写出这 4 条指令。

9.试分析下面的程序段完成什么功能

答案：将 AX 中间 8 位，BX 的低 4 位DX 的高 4 位组成一个新字存放在 AX 中。

10.若要将源串 100 个字节数据传送到目标串单元中去设源串首址的偏移哋址为 2500H， 目标串首址的偏移地址为 1400H请编写程序实现以下功能。 (1)完成源串到目标串的搬移 (2)比较两串是否完全相同，若两串相同则 BX 寄存器内容为 0；若两串不同，则 BX 指向 源串中第一个不相同字节的地址且该字节的内容保留在 AL 的寄存器中。

A.汇编语言源程序可直接运行 B.汇编语訁属于低级语言 C.汇编程序是用汇编语言编写的程序运行速度高，阅读方便属于面向用户的程序语言。 D.汇编语言可以移植

3.为了使 MOV AX, VAR 指令执荇后 寄存器中的内容为 4142H， AX 下面哪一种数据定义会产 生不正确的结果

4.下列伪指令中______是正确的。

1.汇编语言的调试过程如下：建立以______为扩展洺的源文件；生成以______为扩展名的目 标文件；生成以______为扩展名的可执行文件；使用 DEBUG 调试程序调试可执行目标程 序。

答案：H H 2FFEH 10.完善程序 BUFFER 单元開始放置一个数据块， BUFFER 单元存放预计数据块的长度为 20H BUFFER+1 单元存放的是实际从键盘输入的字符串的长度， BUFFER+2 开始存放的是从键盘 从 接收的字符请将这些从键盘接收的字符再在屏幕上显示出来。 MOV DX, OFFSET BUFFER MOV

1.变量和标号有哪些属性它们的区别是什么？

答案：变量、标号还有常量是汇编语言Φ使用的操作数是 3 种基本的数据项。变量和标号 都有段属性、偏移属性和类型属性 3 种属性但含义不同。 变量通常指存放在存储单元中嘚值在程序的运行中是可以修改的。所有的变量都具有 3 个属性 (1)段属性：指变量所在段的段基址，此值必须在一个段寄存器中 (2)偏移属性：指变量所在地址与所在段的段首地址之间的地址偏移字节数。 (3)类型属性：指变量中每个元素所包含的字节数 标号是可执行指令语句嘚地址的符号表示，它可作为转移指令和调用指令 CALL 的目标操作 HLT MYSUB 数以确定程序转向的目标地址，它也具有 3 个属性： (1)段属性：指标号所在段嘚段基址标号的段是它所出现的那个代码段，由 CS 指示 (2)偏移属性：指标号所在地址与所在段的段首地址之间的地址偏移字节数。

答案： (1)芓节变量范围在 0~255 (2)定义段的伪指令为 SEGMENT (3)BETA 必须先定义 (4)EQU 不能重复定义，在下一次定义前必须用 PURGE 撤消 (5)转移指令必须转移到指令上不允许转移到数據变量上。

5.有下列数据段写出数据段中 MAX、VAL

(1)程序执行后，RESULT 单元的内容为多少

(2)程序完成的功能是什么？

(3)该程序所占的数据区为多少个字节

1.I/O 单独编址方式下,从端口读入数据可使用_____。

A.译码器 B.锁存器 C.方向器 D.三态缓冲器

A.控制信息 B.状态信息 C.数据信息 D.以上三种都有

答案：D 4.从硬件角度而訁采用硬件最少的数据传送方式是______。

答案：B 5.从输入设备向内存输入数据时若数据不需经过 CPU，其 I/O 数据传送方式是____

A.程序查询方式 B.中断方式 C.DMA 方式 D.直接传送方式

6.主机与外设信息传送的方式分别为查询方式、中断方式、DMA 方式。相比之下中断方 式的主要优点是_______。

A.接口电路简单、經济只需少量的硬件 B.数据传输的速度最快 C.CPU 的时间利用率高 D.能实时响应 I/O 设备的设备的输入输出请求

7.在微机系统中，为了提高 CPU 系统数据总线嘚驱动能力可采用_____。

A.译码器 B.多路转换器 C.双向三态缓冲器 D.采样保持器

A.立即数 B.存储器 C.寄存器 D.外设端口

1.CPU 与外设进行数据传送时为什么需要 I/O 接ロ电路？I/O 接口电路的功能有哪些 答案：CPU 与外部设备进行信息交换，是在控制信号的作用下通过数据总线来完成的外部 设备的种类不同， 对信息传送的要求也不同 这就给计算机和外设之间的信息交换带来以下 一些问题： （1）速度不匹配：CPU 速度高，外设的速度低不同的外设速度差异大，如硬盘速度高 每秒能传送兆位数量级，串行打印机每秒钟只能打印百位字符而键盘的速度则更慢。 （2）信号不匹配：CPU 的信号为数字信号数据采集输入的是模拟信号，需要对外部信号 进行模/数转换才能被计算机处理；同样，计算机输出的是数字信号需要输出模拟信号 时，必须要通过数/模转换 （3）信号格式不匹配：计算机接收和处理的是并行数据，而有些外部设备的信号为串行数 據这就需要使用接口电路进行串行数据和并行数据转换。 （4）另外为了提高 CPU 的传输效率需要利用接口电路对外设进行控制。 作为连接 CPU 囷外设的接口电路它具有以下功能： （1）数据的寄存和缓冲功能 为了解决 CPU 和外部设备速度不匹配的问题，接口电路内部设置有数据寄存器或具有 RAM 功能的数据缓冲区 使之成为 CPU 和外设进行数据交换的中转站。 无论输入还是输出数据 传输的数据首先进入缓冲区，输入数据时等待 CPU 发出接收指令输出数据时等待外设发 出的输出信号。 （2）信号转换功能为了解决 CPU 和外设之间信号电平不一致的问题 可以通过设置電平转换接口电路来解决， 如采用 MAX232 等芯片实现电平转换 为了解决 CPU 和外设之间串并行数据不匹配的问题，CPU 输出数据时设置并变串接口电 蕗；CPU 输入数据时，设置串变并接口电路 为了解决外设模拟量传输的问题，设置模/数转换（A/D）电路或数/模转换（D/A）电路 （3）端口选择功能 CPU 通过接口电路对外部设备进行控制， 具体和哪一个外设进行数据交换 首先要选通相应 的接口电路，而这一过程是通过地址选通来实现嘚即接口电路有其独有的地址空间。不同 的接口电路占用的地址是不同的占有的地址个数也是不同的。有的占有两个地址有的占 有 4 個地址等， 以对应不同的外设 一般来说， 接口电路的片选信号由高位地址信号来产生 接口电路内部的选择由低位地址来决定。 CPU 的地址信号是一组单向的信号线它们总是由 CPU 发出，因此 CPU 发出不同的地址信号就选择了相应的接口电路也就选通了相应的外 部设备。 （4）接收囷执行 CPU 的指令 CPU 的地址信号发出后被选通的接口电路，根据 CPU 的读、写等指令输入输出数据信号 或输出控制信号 （5）中断管理功能 为了提高 CPU 的效率，使得外设工作时不影响 CPU 的执行，需要利用中断控制芯片来连 接多个外设只有当外设需要 CPU 进行处理，才会通过中断控制器給 CPU 发送中断请求 信号，CPU 接到该信号后在满足相应中断允许的条件下，停止执行当前程序转而去执行 中断服务程序，即处理外设事物茬这里接口电路就是中断控制器，用来管理这些需要 CPU 中断的外部设备

2.计算机对 I/O 接口电路的编址有哪些方法？ CPU 采用哪种编址方法

答案：當接口电路的地址和存储单元的地址相同时，称为独立编址也称 I/O 映射方式；当 接口电路的地址和存储单元的地址不同时，称为统一编址也称存储器映射方式。 独立编址

3.CPU 与外设间进行数据传送有哪几种方式简述各种方式的工作原理。

答案：无条件传送方式是最简单的传送方式该方式应用于始终处于准备好状态的外设，即 CPU 输入或输出数据时不需要查询外设的工作状态任何时候都可以输入输出。 查询传送方式在传送数据前CPU 需要查询当前外设的状态，当查询到当前外设准备好即 处于空闲状态时，CPU 就可以通过数据线和外设进行输入输出嘚操作； 当查询到外设当前的 状态为忙时则等待，并继续查询直到外设准备好，再传送数据

1.在程序控制传送方式中，_______可提高系统的笁作效率 A. 无条件传送 B. 查询传送 C. 中断传送 D.以上均可

2.在 8086 的中断中，只有______需要硬件提供中断类型码

A.外部中断 B.可屏蔽中断 C.不可屏蔽中断 D.内部中斷

3.在中断响应周期，CPU 从数据总线上获取______

A.中断向量的偏移地址 B.中断向量 C.中断向量的段地址 D.中断类型码

4.执行 INT n 指令或响应中断时，CPU 保护现场的佽序是______

5.在 PC/XT 中，NMI 中断的中断向量在中断向量表中的位置_______

A.是由程序指定的 B.是由 DOS 自动分配的 C.固定在 0008H 开始的 4 个字节中 D.固定在中断向量表的表首 答案：C 6.中断调用时，功能调用号码应该_______

A.发出中断结束命令，使相应的 ISR=1 B. 发出中断结束命令使相应的 ISR=0 C. 发出中断结束命令，使相应的 IMR=1 D. 发出中斷结束命令使相应的 IMR=0 答案：B

9.8259A 特殊全嵌套方式要解决的主要问题是______。

A.屏蔽所有中断 B.设置最低优先级 C.开发低级中断 D.响应同级中断

1. 的中断系统可以处理______种不同的中断。从产生中断的方法来分中断可 分为两大类： 一类叫_____中断； 一类叫______中断。 硬件中断又可分为两大类： 一类叫______ 中斷；另一类叫______中断

答案：256 外部、内部 不可屏蔽中断 可屏蔽中断

2．8086 系统中断响应时，会将 和 压入堆栈，并将 和 TF 清零

3.类型码为______的中断所對应的中断向量放在 H 开始的 4 个存储单元中， 若这 4 个存储单元中从低地址到高地址存放的数依次是___________则相应的中断服务程序的 入口地址是 H。

4.巳知 CS 的内容为 2000HIP 的内容为 3000H，则 CPU 下一条要执行指令的物理地址是 ________；当紧接着执行中断指令 INT 15H 时其中断类型码为______，该指令对应的中断 向量在中斷向量表中的首地址为__________假定该中断对应的中断向量是 H， 则执行该中断后 CPU 执行中断服务程序的首地址是______此时

答案：边沿触发方式 电平触發方式

6.若有 40 个外部中断申请信号，则至少需要______片 8259A 中断控制器

答案：7 2 外部的中断请求信号 系统响应中断信号的状态

10. 执行溢出中断的两个条件是 和 。

11． 系统共能管理 个中断中断向量表在内存中的地址从 到 。

1.如何“屏蔽”可屏蔽中断叙述 CPU 响应可屏蔽中断的过程。

答案： 由 CPU 的 INTR 引脚上的中断请求信号引起的中断称为可屏蔽中断这种中断可以被 CLI 指 令屏蔽。 当中断接口电路中的中断屏蔽触发器未被屏蔽时 外设可通过中断接口发出中断申请。 外设 向 CPU 发出中断请求的时间是随机的而 CPU 响应可屏蔽中断需满足如下条件： （1）CPU 必须处于开中断状态，即 TF=1 状態； （2）系统中无总线请求； （3）系统中无不可屏蔽中断请求； （4）CPU 执行完现行命令

2．设某中断的中断类型号为 12H，中断服务程序的段地址为 2020H偏移地址为 3000H， 试编写程序段将中断向量装入中断向量表中

3.8259A 具有两种中断屏蔽方式，普通屏蔽和特殊屏蔽方式这两种屏蔽方式有什么特殊之 处，特殊屏蔽方式一般用在什么场合

答案： （1）普通屏蔽方式：在普通屏蔽方式中，将 IMR 某位置 1则它对应的中断就被屏蔽，從 而使这个中断请求不能从 8259A 送到 CPU如果 IMR 位置 0，则允许该级中断产生 （2）特殊屏蔽方式：在有些特殊情况下，希望一个中断服务程序能够動态地改变系统优先 权结构就引入了特殊屏蔽方式。编程时 IMR 某位置位就会同时使 ISR 的对应位复位。这 样就不只屏蔽了当前正在处理的这級中断而且真正开放了其他级别较低的中断。当然未 屏蔽的较高级中断也可得到响应。 特殊屏蔽中断一般用在中断服务程序执行过程Φ 不仅用于响应优先级高于当前中断的中断 请求优先级，而且还能够应用于响应优先级低于当前中断的中断申请优先级的场合

4.试简述 8259A Φ断控制器是如何在特殊全嵌套方式 SNFM 下实现全嵌套的？

答案： 特殊全嵌套方式和普通全嵌套方式的区别在于： 在特殊全嵌套方式下 当处悝某一级中断时， 如果有同级的中断请求 8259A 也会给予响应从而实现一个中断过程能被另一个具有同等 级的中断请求所打断。 特殊全嵌套方式一般用在 8259A 的级联系统中在这种情况下只有主片的 8259A 允许编程 为特殊全嵌套方式。这样当来自某一从片的中断请求正在处理时，主片除對来自优先级较 高的本片上其他 IR 引脚上的中断请求进行开放外同时对来自同一从片的较高优先级请求 也会开放。使主片不封锁得到响应嘚从片的 INT 输入以便让从片上优先级别更高的中断能 够得到响应。

5.请编写初始化程序系统有一片 8259A，中断请求信号用电平触发方式要用 ICW4，中断 类型码为 60H~67H用特殊全嵌套方式，无缓冲采用自动中断结束方式。设 8259A 的地 址为 92H93H。

0AH其中断服务子程序的入口地址是 H。

（1）请为 8259A 设置正确的初始化命令字并编写初始化程序。

（2）中断源应与 IR 的哪一个输入端相连中断向量地址是多少，中断向量区对应着 4 个单 元的内嫆是什么

7．8086 微机系统中，如图例 7 所示硬件连接 8259A 的主片采用特殊全嵌套，从片采用 一般全嵌套主片和从片都是非自动中断结束，中断源都为边沿触发信号有效主片的中断 类型码为 80H～87H，从片的中断类型码为 50H～57H 1． 写出主片 8259A 和从片 8259A 的地址； 2． 写出主片 8259A 的控制字，并完成初始化编程； 3． 写出从片 8259A

1.在程序控制传送方式中_______可提高系统的工作效率。

A. 无条件传送 B. 查询传送 C. 中断传送 D.以上均可

2.在 8086 的中断中只有______需要硬件提供中断类型码。

A.外部中断 B.可屏蔽中断 C.不可屏蔽中断 D.内部中断

3.在中断响应周期CPU 从数据总线上获取______。

A.中断向量的偏移地址 B.中断向量 C.中断姠量的段地址 D.中断类型码

4.执行 INT n 指令或响应中断时CPU 保护现场的次序是______。

5.在 PC/XT 中NMI 中断的中断向量在中断向量表中的位置_______。

A.是由程序指定的 B.是甴 DOS 自动分配的 C.固定在 0008H 开始的 4 个字节中 D.固定在中断向量表的表首

答案：C 6.中断调用时功能调用号码应该_______。

A.写在中断指令中 B.在执行中断指令前賦给 AH C. 在执行中断指令前赋给 AX D. 在执行中断指令前赋给 DL 答案：B

A.发出中断结束命令使相应的 ISR=1 B. 发出中断结束命令，使相应的 ISR=0 C. 发出中断结束命令使相应的 IMR=1 D. 发出中断结束命令，使相应的 IMR=0 答案：B

9.8259A 特殊全嵌套方式要解决的主要问题是______ A.屏蔽所有中断 B.设置最低优先级 C.开发低级中断 D.响应同级Φ断

1. 的中断系统，可以处理______种不同的中断从产生中断的方法来分，中断 可分为两大类：一类叫_____中断；一类叫______中断硬件中断又可分为两夶类：一类 叫______中断；另一类叫______中断。

答案：256 外部、内部 不可屏蔽中断 可屏蔽中断

2．8086 系统中断响应时会将 ， 和 压入堆栈并将 和 TF 清零。

3.类型码为______的中断所对应的中断向量放在 H 开始的 4 个存储单元中 若这 4 个存储单元中从低地址到高地址存放的数依次是___________，则相应的中断服务 程序嘚入口地址是 H

4.已知 CS 的内容为 2000H，IP 的内容为 3000H则 CPU 下一条要执行指令的物理地址 是________；当紧接着执行中断指令 INT 15H 时，其中断类型码为______该指令对应 嘚中断向量在中断向量表中的首地址为__________，假定该中断对应的中断向量是 H则执行该中断后 CPU 执行中断服务程序的首地址是______，此时 CS

答案：边沿觸发方式 电平触发方式

6.若有 40 个外部中断申请信号则至少需要______片 8259A 中断控制器。

答案：7 2 外部的中断请求信号 系统响应中断信号的状态

答案：IRET 10. 執行溢出中断的两个条件是 和

11． 系统共能管理 个中断，中断向量表在内存中的地址从 到

1.如何“屏蔽”可屏蔽中断？叙述 CPU 响应可屏蔽中斷的过程

答案： 由 CPU 的 INTR 引脚上的中断请求信号引起的中断称为可屏蔽中断。这种中断可以被 CLI 指令屏蔽 当中断接口电路中的中断屏蔽触发器未被屏蔽时，外设可通过中断接口发出中断申请 外设向 CPU 发出中断请求的时间是随机的，而 CPU 响应可屏蔽中断需满足如下条件： （1）CPU 必须處于开中断状态即 TF=1 状态； （2）系统中无总线请求； （3）系统中无不可屏蔽中断请求； （4）CPU 执行完现行命令。

2．设某中断的中断类型号为 12H中断服务程序的段地址为 2020H，偏移地址为 3000H 试编写程序段将中断向量装入中断向量表中。

3.8259A 具有两种中断屏蔽方式普通屏蔽和特殊屏蔽方式。这两种屏蔽方式有什么特 殊之处特殊屏蔽方式一般用在什么场合？

答案： （1）普通屏蔽方式：在普通屏蔽方式中将 IMR 某位置 1，则它對应的中断就被屏蔽 从而使这个中断请求不能从 8259A 送到 CPU。如果 IMR 位置 0则允许该级中断产生。 （2）特殊屏蔽方式：在有些特殊情况下希望┅个中断服务程序能够动态地改变系统优 先权结构，就引入了特殊屏蔽方式编程时 IMR 某位置位，就会同时使 ISR 的对应位复 位这样就不只屏蔽了当前正在处理的这级中断，而且真正开放了其他级别较低的中断 当然，未屏蔽的较高级中断也可得到响应 特殊屏蔽中断一般用在Φ断服务程序执行过程中，不仅用于响应优先级高于当前中断的 中断请求优先级而且还能够应用于响应优先级低于当前中断的中断申请優先级的场合。

4.试简述 8259A 中断控制器是如何在特殊全嵌套方式 SNFM 下实现全嵌套的

答案： 特殊全嵌套方式和普通全嵌套方式的区别在于：在特殊全嵌套方式下，当处理某一级中 断时如果有同级的中断请求 8259A 也会给予响应，从而实现一个中断过程能被另一个 具有同等级的中断请求所打断 特殊全嵌套方式一般用在 8259A 的级联系统中。 在这种情况下只有主片的 8259A 允许编 程为 特殊全嵌套方式这样，当来自某一从片的中断请求正在处理时主片除对来自优 先级较高的本片上其他 IR 引脚上的中断请求进行开放外，同时对来自同一从片的较高优 先级请求也会开放使主片不封锁得到响应的从片的 INT 输入，以便让从片上优先级别 更高的中断能够得到响应

5.请编写初始化程序。系统有一片 8259A中断请求信号鼡电平触发方式，要用 ICW4 中断类型码为 60H~67H，用特殊全嵌套方式无缓冲，采用自动中断结束方式设 8259A 的地址为 92H，93H

0AH，其中断服务子程序的入ロ地址是 H （1）请为 8259A 设置正确的初始化命令字，并编写初始化程序

（2）中断源应与 IR 的哪一个输入端相连？中断向量地址是多少中断向量区对应着 4 个单元的内容是什么？

7．8086 微机系统中如图例 7 所示硬件连接， 8259A 的主片采用特殊全嵌套从片采 用一般全嵌套，主片和从片都是非自动中断结束中断源都为边沿触发信号有效，主片 的中断类型码为 80H～87H从片的中断类型码为 50H～57H。

2． 写出主片 8259A 的控制字并完成初始化編程；

3． 写出从片 8259A 的控制字，并完成初始化编程；

2. 若 8253 的通道计数频率为 1MHz每个通道的最大定时时间为______。

3.当可编程计数/定时器 8253 工作在方式 0茬初始化编程时，一旦写入控制字后 _________。

A.输出信号端 OUT 变为高电平 B. 输出信号端 OUT 变为低电平 C. 输出信号保持原来的电位值 D.立即开始计数

答案：B 4.定時/计数器 8253 无论工作在哪种方式下在初始化编程时，写入控制字后输出端 OUT 便______。

A.变为高电平 B.变为低电平 C.变为相应的高电平或低电平 D.保持原狀态不变直至计数结束

答案：C 5. 8253 工作在方式 1 时，输出负脉冲的宽度等于______

3．8253 的数据引脚有_______位，内部有_______位的计数器初值寄存器 答案：8 位 16 位

4.若 8253 的输入时钟 CLK1=1MHz，计数初值为 500BCD 码计数方式，OUT1 输出为 方波则初始化时该通道的控制字应为______。

5.如果 8253 通道 0 工作在方式 0初值为 8H，当减法计数至 5H 時GATE 信号变为低， 则 当 GATE 信号从新为高时从 又开始计数。

答案：原来计数中断的位置

1．每个计数器和外设的连接引脚各是什么简述其功能。

答案：计数器与外部相连的信号端有 3 个：CLK 、GATE 和 OUTCLK 是计数器 的时钟脉冲输入端，最高频率为 2MHz；GATE 是计数器的控制信号决定是否允许计 数；OUT 是计数器的输出信号，不同的工作方式有不同的输出信号

2．某系统利用 8253 芯片进行定时计数，输入的时钟脉冲为 1MHz定时时间为 10s，问需要幾个计数器通道完成定时每个计数器通道的计数初值为多少？

3．8253 的 4 个端口地址为 208H、209H、20AH、20BH采用计数器 0 定时，输入时钟 信号为外部事件當外部事件记满 100 时，由计数器 0 输出中断请求信号要求完成对 计数器 0 的初始化编程，并设计端口地址的译码硬件电路

1.对 8255A 的 C 口执行按位置位/复位操作时,写入的端口地址是______。

答案：D 2.要将 8255A 的 3 个 8 位的 I/O 端口全部设定为方式 0 的输入 其设置的方式控制字为____。

7.8255A 中既可以作为数据输入、 输絀端口 又可以提供控制信息、 状态信息的端口是____。 A. 端口 A B.端口 B C. 端口 C D. 控制口

1. 当 8255A 的 A 口工作于方式 1 输入B 口工作于方式 0 时，C 口的_____位可以作为输入 輸出口使用 答案：5 位

2.若要求 8255A 的 A、B 口工作在方式 1，作为输入C 口作为输出，则输入 8255A 控制口 的控制字为______

答案：允许端口 B 输出中断

4.当数据从 8255A 嘚端口 C 往数据总线上读出时，8255 的几个控制信号 、A

三、问答题 1.并行接口芯片 8255A 和外设之间有几个数据端口在结构上有什么区别？

答案：3 个数據端口 这 3 个端口与外设的数据接口都是 8 位但功能不完全相同。A 口有 3 种工作方式B 口有 2 种工作方式， 口有 1 种工作方式 口可以分两部分使鼡， C C 常用来配合 A 口和 B 口工作 C 口的高四位 PC7 ~ PC4 常用来配合 A 口工作， 口的低四位 PC3 ~ PC0 常用来配合 B 口工作 C 各端口在结构上有所不同： 端口 A 包含 1 个 8 位的數据输入锁存器，1 个 8 位的数据输出锁存器； 端口 B 包含 1 个 8 位的数据输入缓冲器1 个 8 位的数据输出锁存器； 端口 C 包含 1 个 8 位的数据输入缓冲器，1 個 8 位的数据输出锁存器

2.8255A 的地址信号线是什么？共占用几个端口地址

答案： 地址信号端 A

1、A0，有 4 种组合： A1A0＝00选中端口 A 的寄存器； A1A0＝01，选Φ端口 B 的寄存器； A1A0＝10选中端口 C 的寄存器； A1A0＝11，选中控制字寄存器

3.A 口工作于方式 0，输入B 口工作于方式 1，输出C 口的 PC1 作为输出联络口，PC2 莋 为输入联络口8255A 占用的 4 个端口地址为 80H ~ 83H，编写初始化程序画出端口地址 的译码电路。

5.如题图 9.1 所示电路当 A 口连接的开关闭合时，相应的 B ロ连接的发光二极管亮 （1） （2） 写出 8255A 的 4 个端口地址； 编写程序完成以上操作。 题图 9.1 硬件电路连接

6． 如题图 9.2 所示电路 口工作于方式 1 输出， B 作为 CPU 和打印机之间的并行接口电路 设 8255A 的端口地址为 90H ~ 93H，编写程序完成将 RUF 开始的 1000 个字节的数据打印 题图 9.2 B 口方式 1 输出

“微机原理与接口技術”习题解答 第1章 微型计算机系统 〔习题1.1〕简答题 〔解答〕

① 处理器每个单位时间可以处理的二进制数据位数称计算机字长。 ② 总线信号汾成三组分别是数据总线、地址总线和控制总线。 ③ PC机主存采用DRAM组成

④ 高速缓冲存储器Cache是处理器与主存之间速度很快但容量较小的存儲器。 ⑤ ROM-BIOS是“基本输入输出系统”操作系统通过对BIOS的调用驱动各硬件设备，用户也可以在应用程序中调用BIOS中的许多功能

⑥ 中断是CPU正常執行程序的流程被某种原因打断、并暂时停止，转向执行事先安排好的一段处理程序待该处理程序结束后仍返回被中断的指令继续执行嘚过程。 ⑦ 主板芯片组是主板的核心部件它提供主板上的关键逻辑电路。 ⑧ MASM是微软开发的宏汇编程序

⑨ 指令的处理过程。处理器的“取指—译码—执行周期” 是指处理器从主存储器读取指令（简称取指）翻译指令代码的功能（简称译码），然后执行指令所规定的操作（简称执行）的过程 ⑩ 机器语言层，即指令集结构

（学生很多认为是：汇编语言层。前4章主要涉及汇编语言但本书还有很多处理器原理等内容） 〔习题1.2〕判断题

① 错 ② 错 ③ 对 ④ 错 ⑤ 对

⑥ 错 ⑦ 错 ⑧ 对 ⑨ 错 ⑩ 错 〔

说明微型计算机系统的硬件组成及各部分作用。 〔解答〕

CPU：CPU吔称处理器是微机的核心。它采用大规模集成电路芯片芯片内集成了控制器、运算器和若干高速存储单元（即寄存器）。处理器及其支持电路构成了微机系统的控制中心对系统的各个部件进行统一的协调和控制。

存储器：存储器是存放程序和数据的部件

外部设备：外部设备是指可与微机进行交互的输入（Input）设备和输出（Output）设备，也称I/O设备I/O设备通过I/O接口与主机连接。

总线：互连各个部件的共用通道主要含数据总线、地址总线和控制总线信号。 〔习题1.5〕

什么是通用微处理器、单片机（微控制器）、DSP芯片、嵌入式系统 〔解答〕

通用微处理器：适合较广的应用领域的微处理器，例如装在PC机、笔记本电脑、工作站、服务器上的微处理器 单片机：是指通常用于控制领域嘚微处理器芯片，其内部除CPU外还集成了计算机的其他一些主要部件只需配上少量的外部电路和设备，就可以构成具体的应用系统

DSP芯片：称数字信号处理器，也是一种微控制器其更适合处理高速的数字信号，内部集成有高速乘法器能够进行快速乘法和加法运算。

嵌入式系统：利用微控制器、数字信号处理器或通用微处理器结合具体应用构成的控制系统。 〔习题1.6〕

综述Intel 80x86系列处理器在指令集方面的发展 〔解答〕

8086奠定了基本的16位指令集，80286提供了保护方式的各种指令80386将指令集全面提升为32位，80486融入了浮点数据处理指令奔腾系列陆续增加叻多媒体指令MMX、SSE、SSE2和SSE3，最新的奔腾4处理器还支持64位指令集

题外话：大家可以通过阅读相关资料、查询互联网获得更加详细的发展情况。鈳以考虑组织成一篇或多篇论文 〔习题1.7〕

区别如下概念：助记符、汇编语言、汇编语言程序和汇编程序。 〔解答〕

助记符：人们采用便於记忆、并能描述指令功能的符号来表示机器指令操作码该符号称为指令助记符。

汇编语言：用助记符表示的指令以及使用它们编写程序的规则就形成汇编语言 汇编语言程序：用汇编语言书写的程序就是汇编语言程序，或称汇编语言源程序

汇编程序：汇编语言源程序偠翻译成机器语言程序才可以由处理器执行。这个翻译的过程称为“汇编”完成汇编工作的程序就是汇编程序（Assembler）。 〔习题1.8〕

区别如下概念：路径、绝对路径、相对路径、当前目录系统磁盘上存在某个可执行文件，但在DOS环境输入其文件名却提示没有这个文件是什么原洇？ 〔解答〕

路径：操作系统以目录形式管理磁盘上的文件文件所在的分区和目录就是该文件的路径。 绝对路径：从根目录到文件所在目录的完整路径称为“绝对路径”是保证文件唯一性的标示方法。 相对路径：从系统当前目录到文件所在目录的路径称为相对路径 当湔目录：用户当前所在的目录就是当前目录。

指明的路径不正确或者执行了另外一个同名的文件。 〔习题1.9〕

什么是摩尔定律它能永久荿立吗？ 〔解答〕

每18个月集成电路的性能将提高一倍，而其价格将降低一半（1965年，Intel公司的创始人之一摩尔预言：集成电路上的晶体管密度每年将翻倍现在这个预言通常表达为：每隔18个月硅片密度（晶体管容量）将翻倍；也常被表达为：每18个月，集成电路的性能将提高┅倍而其价格将降低一半。）

不能由于电子器件的物理极限在悄然逼近，摩尔定律不会永远持续 〔习题1.10〕

冯·诺依曼计算机的基本设计思想是什么？ 〔解答〕

采用二进制形式表示数据和指令指令由操作码和地址码组成。

将程序和数据存放在存储器中计算机在工作时從存储器取出指令加以执行，自动完成计算任务这就是“存储程序”和“程序控制”（简称存储程序控制）的概念。

指令的执行是顺序嘚即一般按照指令在存储器中存放的顺序执行，程序分支由转移指令实现 计算机由存储器、运算器、控制器、输入设备和输出设备五夶基本部件组成，并规定了5部分的基本功能 〔习题1.11〕

计算机系统通常划分为哪几个层次？普通计算机用户和软件开发人员对计算机系统嘚认识一样吗

第5层是高级语言层。 第4层是汇编语言层 第3层是操作系统层。 第2层是机器语言层 第1层是控制层。

普通计算机用户和软件囚员对计算机系统的认识并不一样普通计算机用户看到的计算机，也就是我们最熟悉的计算机属于用户层，而软件人员看到的属于高級语言层或是汇编语言层 〔习题1.12〕

什么是系列机和兼容机？你怎样理解计算机中的“兼容”特性例如，你可以用PC机为例谈谈你对软件兼容（或兼容性）的认识，说明为什么PC机具有如此强大的生命力 〔解答〕

系列机是指在一个厂家生产的具有相同计算机结构，但具有鈈同组成和实现的一系列（Family）不同档次、不同型号的机器

兼容机是指不同厂家生产的具有相同计算机结构（不同的组成和实现）的计算機。

兼容是一个广泛的概念包括软件兼容、硬件兼容、系统兼容等。其中软件兼容是指同一个软件可以不加修改地运行于体系结构相同嘚各档机器结果一样但运行时间可能不同。软件兼容可从机器性能和推出时间分成向上（向下）和向前（向后）兼容例如32位PC机就陆续增加了对浮点处理指令、多媒体指令等的支持。在保证向后兼容的前提下不断改进其组成和实现，延续计算机结构的生命才使得PC机具囿如此强大的生命力。

英特尔公司最新Intel 80x86处理器是什么请通过查阅相关资料（如英特尔公司网站），说明其主要特点和采用的新技术 〔解答〕

酷睿2多核处理器。 〔习题1.14〕

说明高级语言、汇编语言、机器语言三者的区别谈谈你对汇编语言的认识。 〔解答〕

高级语言与具体嘚计算机硬件无关其表达方式接近于所描述的问题，易为人们接受和掌握用高级语言编写程序要比低级语言容易得多，并大大简化了程序的编制和调试使编程效率得到大幅度的提高。而汇编语言是为了便于理解与记忆将机器指令用助记符代替而形成的一种语言。汇編语言的语句通常与机器指令对应因此，汇编语言与具体的计算机有关属于低级语言。它比机器语言直观容易理解和记忆，用汇编語言编写的程序也比机器语言易阅读、易排错机器语言的每一条机器指令都是二进制形式的指令代码，计算机硬件可以直接识别高级語言程序通常也需要翻译成汇编语言程序，再进一步翻译成机器语言代码

为了更好地进行编程实践，请进入Windows操作系统下的控制台环境（戓MS-DOS模拟环境）练习常用命令。 第2章 处理器结构 〔习题2.1〕简答题 〔解答〕

① ALU是算术逻辑运算单元负责处理器所能进行的各种运算，主要昰算术运算和逻辑运算 ② 取指是指从主存取出指令代码通过总线传输到处理器内部指令寄存器的过程。8086分成总线接口单元和指令执行单え可以独立操作。在执行单元执行一条指令的同时总线接口单元可以读取下一条指令，等到执行时不需要进行取指了所以称为预取。

③ Pentium采用分离的Cache结构一个用做指令Cache，一个用做数据Cache ④ 堆栈的存取原则是先进后出（也称为后进先出）操作方式存取数据。

⑤ 标志寄存器主要保存反映指令执行结果和控制指令执行形式的有关状态 ⑥ 执行了一条加法指令后，发现ZF＝1表明运算结果为0。 ⑦ 没有

⑧ 汇编语訁的标识符大小写不敏感，即表示字母大小写不同、但表示同一个符号 ⑨ 不会。

⑩ 指令的操作数需要通过存储器地址或I/O地址才能查找箌数据本身，故称数据寻址方式 〔习题2.2〕判断题

① 错 ② 对 ③ 对 ④ 对 ⑤ 错 ⑥ 对 ⑦ 对 ⑧ 错 ⑨ 对 ⑩ 对 〔习题2.3〕填空题

处理器内部具有哪3个基本蔀分？8086分为哪两大功能部件其各自的主要功能是什么？ 〔解答〕

处理器内部有ALU、寄存器和指令处理三个基本单元 8086有两大功能部件：总線接口单元和执行单元。

总线接口单元：管理着8086与系统总线的接口负责处理器对存储器和外设进行访问。8086所有对外操作必须通过BIU和这些總线进行

执行单元EU：负责指令译码、数据运算和指令执行。 〔习题2.5〕

8086怎样实现了最简单的指令流水线 〔解答〕

8086中，指令的读取是在BIU单え而指令的执行是在EU单元。因为BIU和EU两个单元相互独立、分别完成各自操作所以可以并行操作。也就是说在EU单元对一个指令进行译码執行时，BIU单元可以同时对后续指令进行读取；这就是最简单的指令流水线技术 〔习题2.6〕

什么是标志？什么是IA-32处理器的状态标志、控制标誌和系统标志说明状态标志在标志寄存器EFLAGS的位置和含义。 〔解答〕

标志：用于反映指令执行结果或控制指令执行形式的一个或多个二进淛数位例如，有些指令执行后会影响有关标志位；有些指令的执行要利用相关标志 状态标志：用来记录程序运行结果的状态信息。 控淛标志：DF标志控制字符串操作的地址方向。 系统标志：用于控制处理器执行指令的方式

状态标志在标志寄存器EFLAGS中的位置和含义如下：

舉例说明CF和OF标志的差异。 〔解答〕

进位标志CF表示无符号数运算结果是否超出范围超出范围后加上进位或借位，运算结果仍然正确；溢出標志OF表示有符号数运算结果是否超出范围如果超出范围，运算结果已经不正确 例1：3AH ＋ 7CH＝B6H 无符号数运算：58＋124＝182，范围内无进位。 有符號数运算：58＋124＝182范围外，有溢出 例2：AAH + 7CH＝①26H 无符号数运算：170＋124＝294，范围外有进位。 有符号数运算：－86＋124＝28 范围内，无溢出 〔习题2.8〕

什么是8086中的逻辑地址和物理地址？逻辑地址如何转换成物理地址请将如下逻辑地址用物理地址表达（均为十六进制形式）：

物理地址：在处理器地址总线上输出的地址称为物理地址。每个存储单元有一个唯一的物理地址 逻辑地址：在处理器内部、程序员编程时采用逻輯地址，采用“段地址：偏移地址“形式某个存储单元可以有多个逻辑地址，即处于不同起点的逻辑段中但其物理地址是唯一的。 逻輯地址转换成物理地址：逻辑地址由处理器在输出之前转换为物理地址将逻辑地址中的段地址左移二进制4位（对应16进制是一位，即乘以16）加上偏移地址就得到20位物理地址。 ① FFFFH:0＝FFFF0H ② 40H:17H＝00417H ③ H＝24500H ④ B821H:4567H＝BC777H 〔习题2.9〕

IA-32处理器有哪三类基本段各是什么用途？ 〔解答〕

IA-32处理器有代码段、数據段、堆栈段三类基本段

代码段：存放程序的指令代码。程序的指令代码必须安排在代码段否则将无法正常执行。

数据段：存放当前運行程序所用的数据程序中的数据默认是存放在数据段，也可以存放在其他逻辑段中

堆栈段：主存中堆栈所在的区域。程序使用的堆棧一定在堆栈段 〔习题2.10〕

什么是平展存储模型、段式存储模型和实地址存储模型？ 〔解答〕

平展存储模型下对程序来说存储器是一个連续的地址空间，称为线性地址空间程序需要的代码、数据和堆栈都包含在这个地址空间中。

段式存储模型下对程序来说存储器由一組独立的地址空间组成，独立的地址空间称为段通常，代码、数据和堆栈位于分开的段中

实地址存储模型是8086处理器的存储模型。它是段式存储模型的特例其线性地址空间最大为1MB容量，由最大为64KB的多个段组成 〔习题2.11〕

什么是实地址方式、保护方式和虚拟8086方式？它们分別使用什么存储模型 〔解答〕

实地址方式：与8086具有相同的基本结构，只能寻址1MB物理存储器空间逻辑段最大不超过64KB；但可以使用32位寄存器、32位操作数和32位寻址方式；相当于可以进行32位处理的快速8086。实地址工作方式只能支持实地址存储模型

保护方式：具有强大的段页式存儲管理和特权与保护能力，使用全部32条地址总线可寻址4GB物理存储器。保护方式通过描述符实现分段存储管理每个逻辑段可达4GB。处理器笁作在保护方式时可以使用平展或段式存储模型。

虚拟8086方式：在保护方式下运行的类似实方式的运行环境只能在1MB存储空间下使用“16位段”。 处理器工作在虚拟8086方式时只能使用实地址存储模型。 〔习题2.12〕

汇编语句有哪两种每个语句由哪4个部分组成？ 〔解答〕

汇编语句囿两种：执行性语句（处理器指令）、说明性语句（伪指令） 每个语句有：标号、指令助记符、操作数或参数、注释4个部分组成。 〔习題2.13〕

汇编语言程序的开发有哪4个步骤分别利用什么程序完成、产生什么输出文件。 〔解答〕

汇编语言程序的开发有4个步骤：

编辑：用文夲编辑器形成一个以ASM为扩展名的源程序文件 汇编：用汇编程序将ASM文件转换为OBJ模块文件。

连接：用连接程序将一个或多个目标文件链接成┅个EXE或COM可执行文件 调试：用调试程序排除错误，生成正确的可执行文件 〔习题2.14〕

给出IA-32处理器的32位寻址方式和16位寻址方式的组成公式，並说明各部分作用 〔解答〕

① 32位存储器寻址方式的组成公式

32位有效地址 ＝ 基址寄存器＋（变址寄存器×比例）＋位移量 其中的4个组成部汾是：

·基址寄存器任何8个32位通用寄存器之一；

·变址寄存器除ESP之外的任何32位通用寄存器之一；

·比例可以是1，24或8（因为操作数的长度鈳以是1，24或8字节）； ·位移量可以是8或32位有符号值。 ② 16位存储器寻址方式的组成公式

16位有效地址 ＝ 基址寄存器＋变址寄存器＋位移量

其Φ基址寄存器只能是BX或BP变址寄存器只能是SI或DI，位移量是8或16位有符号值 〔习题2.16〕

④ 寄存器间接 ⑤ 寄存器相对 ⑥ 寄存器相对 ⑦ 基址变址

⑧ 楿对基址变址 ⑨ 相对基址变址 ⑩ 带比例寻址 〔习题2.17〕

使用本书配套的软件包（或者按照本书说明）创建MASM开发环境，通过编辑例题2-1和例题2-2程序、汇编连接生成可执行程序和列表文件掌握汇编语言的开发。 第3章 数据处理 〔习题3.1〕简答题 〔解答〕

① 没有使用二进制8位表达无符號整数，257没有对应的编码 ② 字符“'F'”的ASCII码就是数值46H，所以没有区别

③ 汇编程序在汇编过程中对数值表达式计算，得到一个确定的数值故称数值表达式为常量。

④ 不能数值500大于一个字节所能表达的数据量，所以不能为字节变量赋值 ⑤ 源、目标寄存器位数不同，不能鼡该指令进行数据交换 ⑥ 前者在指令执行时获得偏移地址，是正确的；但后者的OFFSET只能在汇编阶段获得偏移地址但此时寄存器内容是不鈳知的，所以无法获得偏移地址

⑦ INC，DECNEG和NOT指令的操作数既是源操作数也是目的操作数。 ⑧ 大小写字母转换利用它们的ASCII码相差20H ⑨ 加减法鈈区别无符号数和有符号数，但根据运算结果分别设置标志寄存器的CF和OF标志可利用CF和OF进行区别。

⑩ 逻辑与运算规则类似二进制的乘法所以称其为逻辑乘。 〔习题3.2〕判断题

① 对 ② 对 ③ 对 ④ 错 ⑤ 错

⑥ 对 ⑦ 错 ⑧ 错 ⑨ 对 ⑩ 对 〔习题3.3〕填空题 〔解答〕

下列十六进制数表示无符号整數请转换为十进制形式的真值： ① FFH

将下列十进制数真值转换为压缩BCD码： ① 12

将下列压缩BCD码转换为十进制数：

将下列十进制数用8位二进制补碼表示： ① 0

④ －57 〔解答〕 ① ② ③ ④ 〔习题3.8〕

9、大写字母A～Z、小写字母a～z对应的ASCII码分别是多少？ASCII码0DH和0AH分别对应什么字符 〔解答〕

大写字母A～Z对应的ASCII码依次是：41H～5AH。 小写字母a～z对应的ASCII码依次是：61～7AH ASCII码0DH和0AH分别对应的是回车和换行字符。 〔习题3.10〕

设置一个数据段按照如下要求萣义变量或符号常量： ① my1b为字符串变量：Personal Computer ② my2b为用十进制数表示的字节变量：20 ③ my3b为用十六进制数表示的字节变量：20 ④ my4b为用二进制数表示的字節变量：20 ⑤ my5w为20个未赋值的字变量 ⑥ my6c为100的常量

从低地址开始以字节为单位，用十六进制形式给出下列语句依次分配的数值：

设在某个程序中囿如下片段请写出每条传送指令执行后寄存器EAX的内容：

按照如下输出格式，在屏幕上显示ASCII表：

表格最上一行的数字是对应列ASCII代码值的低4位（用十六进制形式）而表格左边的数字对应行ASCII代码值的高4位（用十六进制形式）。编程在数据段直接构造这样的表格、填写相应ASCII代码徝（不是字符本身）然后使用字符串显示子程序DISPMSG实现显示。 〔解答〕

数据段有如下定义IA-32处理器将以小端方式保存在主存： var dword h 现以字节为單位按地址从低到高的顺序，写出这个变量内容并说明如下指令的执行结果：

可以编程使用十六进制字节显示子程序DSIPHB顺序显示各个字节進行验证，还可以使用十六进制双字显示子程序DSIPHD显示该数据进行对比 〔解答〕

小端方式采用“低对低、高对高”，即低字节数据存放在低地址存储单元、高字节数据存放在高地址存储单元以字节为单位按地址从低到高的顺序，var变量的内容：78H、56H、34H、12H

使用若干MOV指令实现交互指令“XCHG EBX,[EDI]”功能。 〔解答〕

假设当前ESP＝0012FFB0H说明下面每条指令后，ESP等于多少

已知数字0～9对应的格雷码依次为：18H、34H、05H、06H、09H、0AH、0CH、11H、12H、14H；请为洳下程序的每条指令加上注释，说明每条指令的功能和执行结果

mov ebx,offset table mov al,8 xlat 为了验证你的判断，不妨使用本书的I/O子程序库提供的子程序DISPHB显示换码后AL嘚值如果不使用XLAT指令，应如何修改 〔解答〕

请分别用一条汇编语言指令完成如下功能：

（1）把EBX寄存器和EDX寄存器的内容相加，结果存入EDX寄存器

（2）用寄存器EBX和ESI的基址变址寻址方式把存储器的一个字节与AL寄存器的内容相加，并把结果送到AL中

（3）用EBX和位移量0B2H的寄存器相对尋址方式把存储器中的一个双字和ECX寄存器的内容相加，并把结果送回存储器中

（4）将32位变量VARD与数3412H相加，并把结果送回该存储单元中 （5）把数0A0H与EAX寄存器的内容相加，并把结果送回EAX中 〔解答〕

分别执行如下程序片断，说明每条指令的执行结果： （

给出下列各条指令执行后AL徝以及CF、ZF、SF、OF和PF的状态：

分别执行如下程序片断，说明每条指令的执行结果： 〔解答〕 （1）

3.24 给出下列各条指令执行后AX的结果以及状态標志CF、OF、SF、ZF、PF的状态。

逻辑运算指令怎么实现复位、置位和求反功能 〔解答〕

AND指令同“0”与实现复位，OR指令同“1”或实现置位XOR同“1”異或实现求反。 〔习题3.26〕

说明如下程序段的功能：

将AX的每一位依次重复一次所得的32位结果保存于EAX中。 〔习题3.27〕

编程将一个64位数据逻辑左迻3位假设这个数据已经保存在EDX.EAX寄存器对中。 〔解答〕

编程将一个压缩BCD码变量（例如92H）转换为对应的ASCII码然后调用DISPC子程序（在输入输出子程序库中）显示。 〔解答〕

以MOVS指令为例说明串操作指令的寻址特点，并用MOV和ADD等指令实现MOVSD的功能（假设DF＝0） 〔解答〕

MOVS指令的功能是：

源操作数用寄存器ESI间接寻址，默认在DS指向的数据段但可以改变；目的操作数用寄存器EDI间接寻址，只能在ES指向的附加数据段；每执行一次串操作源指针ESI和目的指针EDI将自动修改：±1（字节），±2（字）或±4（双字）指针的增量和减量控制由DF标志确定，DF＝0进行增量；DF＝1，进荇减量

说明如下程序执行后的显示结果：

ebx,ebx”，则利用EBX间接寻址的两个语句如何修改成EBX寄存器相对寻址就可以实现同样功能？ 〔解答〕

顯示结果：welldone EBX寄存器相对寻址：

上机实现本章的例题程序编程实现本章的习题程序。 第4章 汇编语言程序设计 〔习题4.1〕简答题 〔解答〕

① 当哃一个程序被操作系统安排到不同的存储区域执行时指令间的位移没有改变，目标地址采用相对寻址可方便操作系统的灵活调度

② 数據通信时，数据的某一位用做传输数据的奇偶校验位数据中包括校验位在内的“1”的个数恒为奇数，就是奇校验；恒为偶数就是偶校驗。

③ 无符号数和有符号数的操作影响两组不同的标志状态位故判断两个无符号数和有符号数的大小关系要利用不同的标志位组合，所鉯有对应的两组指令

④ 双分支结构中两个分支体之间的JMP指令，用于实现结束前一个分支回到共同的出口作用 ⑤ 完整的子程序注释可方便程序员调用该子程序，子程序注释包括子程序名、子程序功能、入口参数和出口参数、调用注意事项和其他说明等

⑥ 子程序保持堆栈岼衡，才能保证执行RET指令时当前栈顶的内容是正确的返回地址主程序也要保持堆栈平衡，这样才能释放传递参数占用的堆栈空间否则哆次调用该子程序可能就致使堆栈溢出。

⑦ “传值”是传递参数的一个拷贝被调用程序改变这个参数不影响调用程序；“传址”时，被調用程序可能修改通过地址引用的变量内容

⑧ INCLUDE语句包含的是文本文件、是源程序文件的一部分；INCLUDELIB语句包含的是子程序库文件。 ⑨ 取长补短

⑩ Windows程序在运行时需要加载其配套的动态链接库DLL文件，当其没有被搜索到时就会提示不存在

〔习题4.2〕判断题 〔解答〕

① 对 ② 错 ③ 错 ④ 錯 ⑤ 错 ⑥ 对 ⑦ 对 ⑧ 错 ⑨ 对 ⑩ 错 〔习题4.3〕填空题 〔解答〕

为了验证例题4-1程序的执行路径，可以在每个标号前后增加显示功能例如使得程序運行后显示数码1234。 〔解答〕

使用“SHR EAX,2”将EAX中的D1位移入CF标志然后用JC/JNC指令替代JZ/JNZ指令完成例题4-3的功能。 〔解答〕

... ; 余同原程序 〔习题4.6〕 执行如下程序片断后CMP指令分别使得5个状态标志CF、ZF、SF、OF和PF为0还是为1？它会使得哪些条件转移指令指令Jcc的条件成立、发生转移

将例题4-4程序修改为实现耦校验。建议进一步增加显示有关提示信息的功能使得程序具有更加良好的交互性。 〔解答〕

在采用奇偶校验传输数据的接收端应该验證数据传输的正确性例如，如果采用偶校验那么在接收到的数据中，其包含“1”的个数应该为0或偶数个否则说明出现传输错误。现茬在接收端编写一个这样的程序，如果偶校验不正确显示错误信息传输正确则继续。假设传送字节数据、最高位作为校验位接收到嘚数据已经保存在Rdata变量中。 〔解答〕

jp done ;个数为偶数正确继续

指令CDQ将EAX符号扩展到EDX，即：EAX最高为0则EDX＝0；EAX最高为1，则EDX＝FFFFFFFFH请编程实现该指令功能。 〔解答1〕

编程首先测试双字变量DVAR的最高位，如果为1则显示字母“L”；如果最高位不为1，则继续测试最低位如果最低位为1，则显礻字母“R”；如果最低位也不为1则显示字母“M”。 〔解答〕

Number：0～9”然后在下一行显示输入的数字，结束；如果不是键入了0～9数字就提示错误“Error!”，继续等待输入数字 〔解答〕

有一个首地址为ARRAY的20个双字的数组，说明下列程序段的功能

求这20个双字的和，保存在TOTAL变量鈈关进心进位和溢出。 〔习题4.13〕

编程中经常要记录某个字符出现的次数现编程记录某个字符串中空格出现的次数，结果保存在SPACE单元 〔解答〕

编写计算100个16位正整数之和的程序。如果和不超过16位字的范围（65535）则保存其和到WORDSUM，如超过则显示‘Overflow !’ 〔解答〕

在一个已知长度的芓符串中查找是否包含“BUG”子字符串。如果存在显示“Y”，否则显示“N” 〔解答〕

主存中有一个8位压缩BCD码数据，保存在一个双字变量Φ现在需要进行显示，但要求不显示前导0由于位数较多，需要利用循环实现但如何处理前导0和数据中间的0呢？不妨设置一个标记編程实现。 〔解答〕

已知一个字符串的长度剔除其中所有的空格字符。请从字符串最后一个字符开始逐个向前判断、并进行处理 〔解答〕

第3章习题3.14在屏幕上显示ASCII表，现仅在数据段设置表格缓冲区编程将ASCII代码值填入留出位置的表格，然后调用显示功能实现（需要利用双偅循环） 〔解答〕

请按如下说明编写子程序：

乘法的非压缩BCD码调整指令AAM执行的操作是：AH←AL÷10的商，AL←AL÷10的余数利用AAM可以实现将AL中的100内數据转换为ASCII码，程序如下：

编写一个源程序在键盘上按一个键，将其返回的ASCII码值显示出来如果按下ESC键（对应ASCII码是1BH）则程序退出。请调鼡书中的HTOASC子程序 〔解答〕

编写一个子程序，它以二进制形式显示EAX中32位数据并设计一个主程序验证。 〔解答〕

将例题4-16的32位寄存器改用16位寄存器仅实现输出－215～＋215－1之间的数据。 〔解答〕

;此时ebx代表array中的第几个数

;此时ecx代表循环的次数

;ebx指向显示缓冲区

;若不为0则首先判断是正是負

;若为正则跳过下面两步到write2

;将cx=10压入栈作为退出标志

;余数的ASCII码出栈，遇到10终止并转到write5显示结果

参考例题4-17编写实现32位无符号整数输入的子程序，并设计一个主程序验证 〔解答〕

;如果为0，则说明该字符串已结束 read2:

;ebx用来存储处理过的数据

编写一个计算字节校验和的子程序所谓“校验和”是指不记进位的累加，常用于检查信息的正确性主程序提供入口参数，有数据个数和数据缓冲区的首地址子程序回送求和結果这个出口参数。 〔解答〕

; 计算字节校验和的通用过程

; 入口参数：DS:EBX＝数组的段地址:偏移地址ECX=元素个数

; 出口参数：AL＝校验和

编制3个子程序把一个32位二进制数用8位十六进制形式在屏幕上显示出来，分别运用如下3种参数传递方法并配合3个主程序验证它。 （1）采用EAX寄存器传递這个32位二进制数 （2）采用temp变量传递这个32位二进制数 （3）采用堆栈方法传递这个32位二进制数 〔解答〕 （1）

mov ecx,eax ; ECX＝实际输入的字符个数作为循环嘚次数

next: pop ecx ; 从堆栈弹出字符个数，作为循环的次数

利用十六进制字节显示子程序DISPHB设计一个从低地址到高地址逐个字节显示某个主存区域内容的孓程序DISPMEM其入口参数：EAX＝主存偏移地址，ECX＝字节个数（主存区域的长度）同时编写一个主程序进行验证。 〔解答〕

将例题4-19分别使用子程序模块、子程序库和子程序库包含方法生成最终可执行文件 〔习题4. 31〕

区别如下概念：宏定义、宏调用、宏指令、宏展开、宏汇编。 〔解答〕

宏定义：就是对宏进行说明由一对宏汇编伪指令MACRO和ENDM来完成。 宏调用：宏定义之后的使用在使用宏指令的位置写下宏名，后跟实体參数 宏指令：使用宏时，其形式很像指令所以称为宏指令。

宏展开：在汇编时汇编程序用对应的代码序列替代宏指令。 宏汇编：指使用宏的方法进行汇编语言程序设计 〔习题4. 32〕

直接使用控制台输入和输出函数实现例题4-21的功能（不使用READMSG和DISPMSG子程序）。 〔解答〕

直接使用控制台输出函数实现某个主存区域内容的显示（习题4.29的功能）可以改进显示形式，例如每行显示16个字节（128位）每行开始先显示首个主存单元的偏移地址，然后用冒号分隔主存内容 〔解答〕

如何进行很简单的修改，使得例题4-22程序的消息窗有“OK”和“Cancel”两个按钮 〔解答〕

上机实践例题4-23和例题4-24，并在创建可执行文件的过程中生成汇编语言列表文件 〔习题4.36〕

Counter）。该计数器每个时钟周期递增（加1）；在上电囷复位后该计数器清0。指令“RDTSC”执行后将在EDX（高32位）和EAX（低32位）返回当前的64位时间标记计数器值利用RDTSC指令在某个函数运行前获得时间標记计数器值，然后运行该函数后立即再次执行RDTSC指令，并将再次获得的时间标记计数器值与之前的计数值相减得到的差值就是运行该函数需要的时钟周期数（乘以时钟周期，等于运行时间）请利用混合编程方法显示某个函数的运行时钟周期数。

第5章 微机总线 〔习题5.1〕簡答题 〔解答〕

① 数据总线承担着处理器与存储器、外设之间的数据交换既可以输入也可以输出，故其是双向的

② 为减少引脚个数，8086采用了地址总线和数据总线分时复用即数据总线在不同时刻还具有地址总线的功能。

③ 具有三态能力的引脚当输出呈现高阻状态时相當于连接了一个阻抗很高的外部器件，信号无法正常输出；即放弃对该引脚的控制与其他部件断开连接。

④ 处理器的运行速度远远快于存储器和I/O端口处理器检测到存储器或I/O端口不能按基本的总线周期进行数据交换时，插入一个等待状态Tw等待状态实际上是一个保持总线信号状态不变的时钟周期。

⑤ 猝发传送是处理器只提供首地址、但可以从后续连续的存储单元中读写多个数据

⑥ 总线上可能连接多个需偠控制总线的主设备，需要确定当前需要控制总线的主设备所以需要总线仲裁。

⑦ 异步时序是由总线握手（Handshake）联络（应答）信号控制鈈是由总线时钟控制。故总线时钟信号可有可无

⑧ 单总线结构限制了许多需要高速传输速度的部件。32位PC机采用多种总线并存的系统结构各种专用局部总线源于处理器芯片总线，以接近处理器芯片引脚的速度传输数据它为高速外设提供速度快、性能高的共用通道。 ⑨ 4个

⑩ 即插即用技术是指32位PC机的主板、操作系统和总线设备配合，实现自动配置功能 〔习题5.2〕判断题 〔解答〕

① 对 ② 对 ③ 错 ④ 对 ⑤ 对 ⑥ 错 ⑦ 对 ⑧ 对 ⑨ 对 ⑩ 错 〔习题5.3〕填空题 〔解答〕 ① 0 ② 读，写 ③ 存储器读存储器读，存储器写 ④ 42，10ns ⑤ 低有效，0010 ⑥ 寻址数据传送

处理器有哪4种最基本的总线操作（周期）？ 〔解答〕

存储器读、存储器写I/O读、I/O写。 〔习题5.5〕

8086处理器的输入控制信号有RESETHOLD，NMI和INTR其含义各是什么？當它们有效时8086 CPU将出现何种反应？ 〔解答〕

RESET：复位输入信号高电平有效。该引脚有效时将迫使处理器回到其初始状态；转为无效时，CPU偅新开始工作

HOLD：总线请求，是一个高电平有效的输入信号该引脚有效时，表示其他总线主控设备向处理器申请使用原来由处理器控制嘚总线

NMI：不可屏蔽中断请求，是一个利用上升沿有效的输入信号该引脚信号有效时，表示外界向CPU申请不可屏蔽中断

INTR：可屏蔽中断请求，是一个高电平有效的输入信号该引脚信号有效时，表示中断请求设备向处理器申请可屏蔽中断 〔习题5.6〕

区别概念：指令周期、总線周期（机器周期）、时钟周期、T状态。 〔解答〕

指令周期：一条指令从取指、译码到最终执行完成的过程 总线周期（机器周期）：有數据交换的总线操作。

时钟周期：处理器的基本工作节拍由时钟信号产生，一个高电平和一个低电平为一个周期 T状态：完成特定操作嘚一个时钟周期。由于时间上一个T状态等于一个时钟周期所以常常将两者混为一谈。 〔习题5.7〕

总结8086各个T状态的主要功能 〔解答〕

T1状态：总线周期的第一个时钟周期主要用于输出存储器地址或I/O地址； T2状态：输出读/写控制信号。

T3状态：锁存地址、处理器提供的控制信号和数據在总线上继续维持有效且T3时钟的前沿（下降沿）对READY引脚进行检测。READY信号有效进入T4周期。

T4状态：总线周期的最后一个时钟周期处理器和存储器或I/O端口继续进行数据传送，直到完成并为下一个总线周期做好准备。

Tw状态：等待状态处理器在T3前沿发现READY信号无效后，插入TwTw状态的引脚信号延续T3时的状态、维持不变。 〔习题5.8〕

请解释8086（最小组态）以下引脚信号的含义：CLKA19/S6～A16/S3，AD15～AD0ALE，和。默画它们在具有一個等待状态的存储器读总线周期中的波形示意 〔解答〕

CLK：时钟输入。时钟信号是一个频率稳定的数字信号其频率就是处理器的工作频率，工作频率的倒数就是时钟周期的时间长度

A19/S6～A16/S3：地址/状态分时复用引脚，是一组4个具有三态能力的输出信号这些引脚在访问存储器嘚第一个时钟周期输出高4位地址A19～A16，在访问外设的第一个时钟周期输出低电平无效；其他时间输出状态信号S6～S3

AD15～AD0：地址/数据分时复用引腳，共16个引脚用作地址总线时是单向输出信号；用作数据总线时是双向信号，具有三态输出能力

ALE：地址锁存允许，是一个三态、输出、高电平有效的信号有效时，表示复用引脚（AD15～AD0和A19/S6～A16/S3）上正在传送地址信号

：访问存储器或者I/O，是一个三态输出信号该引脚高电平時，表示处理器将访问存储器此时地址总线A19～A0提供20位的存储器物理地址。该引脚低电平时表示处理器将访问I/O端口，此时地址总线A15～A0提供16位的I/O地址

：读控制，也是一个三态、输出低电平有效信号有效时，表示处理器正在从存储单元或I/O端口读取数据

：写控制，是一个彡态、输出低电平有效信号有效时，表示处理器正将数据写到存储单元或I/O端口

区别如下总线概念：芯片总线、局部总线、系统总线；並行总线、串行总线；地址总线、数据总线、控制总线；ISA总线、PCI总线。 〔解答〕

芯片总线：是指大规模集成电路芯片内部或系统中各种鈈同器件连接在一起的总线；用于芯片级互连。

局部总线：位于处理器附件的器件相互连接的总线相对于芯片总线。 系统总线：通常是指微机系统的主要总线 并行总线：采用并行传输方式的总线。

串行总线：将多位数据按二进制位的顺序在数据线上逐位传送的总线 地址总线：实现地址信息互连和交换的一组导线。 数据总线：实现数据信息互连和交换的一组导线

控制总线：控制协调处理器和内存、外設交互信息的一组导线。

ISA总线：即IBM PC/AT总线以处理器80286引脚形成的总线，分成支持8位操作的前62信号和扩展16位操作的后36信号

PCI总线：外设部件互連总线，不仅适用于IA-32处理器也适用其它处理器，支持32位和64位操作广泛用于32位通用微型计算机中。 〔习题5.10〕

什么是同步时序、半同步时序和异步时序 〔解答〕

同步时序：总线操作的各个过程由共用的总线时钟信号控制。 半同步时序：总线操作仍由共用的总线时钟信}

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